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求DDR1 DDR2 DDR3布线规则设置

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发表于 2012-11-21 17:28 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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求DDR1 DDR2 DDR3布线规则设置:除了数据,地址线分为两组来进行绕等长设置,还有那些线需要进行分组,绕等长之间的公差又是根据什么来设的呢?时钟线将要跟哪些信号线归为一组?请大虾们指点。
  • TA的每日心情
    慵懒
    2025-2-10 15:39
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    [LV.4]偶尔看看III

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    发表于 2012-12-9 00:39 | 只看该作者
    我把ddr3歸類放上去ddr2ddr1只比ddr3少幾pin分類是一樣的; n; k/ G! l1 y7 V
    有分兩大類DQ跟AD其中DQ還可再分兩組
    & {- k$ T1 w9 _% h& }  o2 b# w3 h' U# s* I5 @9 k

    ( \8 k" v+ C4 X8 b& A3 UAD                  DQ1        DQ2
    8 J- j; Y" H5 A' G  \. t+ @% mSD1_A0        SD_DM0        SD_DM2
    1 g2 ]4 e& T9 d7 O  f/ b1 GSD1_A1        SD_DQ0        SD_DQ16. J+ J% l+ e( Y5 s0 ]" @  }
    SD1_A10        SD_DQ1        SD_DQ17
    # p- I" S: V' rSD1_A11        SD_DQ2        SD_DQ18" s* L4 O# @) m3 e8 O1 L& t+ j! i
    SD1_A12        SD_DQ3        SD_DQ191 w! J3 n) s) f. j8 E# k
    SD1_A13        SD_DQ4        SD_DQ20
    # j2 I, U$ _" V2 ~8 c  u  jSD1_A14        SD_DQ5        SD_DQ21
    5 t( q. _) E' M% tSD1_A15        SD_DQ6        SD_DQ22
    & l0 o' c' ?3 n/ z2 E: x& n1 ]SD1_A2        SD_DQ7        SD_DQ23
    & V& V5 j) F1 n4 k# x; qSD1_A3        SD_DQS0-        SD_DQS2-- \! }# f( H# ?" `- ^& Y
    SD1_A4        SD_DQS0+        SD_DQS2+
    . N' Y* c0 u. E& CSD1_A5        SD_DM1        SD_DM3/ K: N0 |4 Q6 P: b$ [
    SD1_A6        SD_DQ8        SD_DQ24
    0 v! p4 y  W8 aSD1_A7        SD_DQ9        SD_DQ25
    . @. l% v" C5 `" Y5 h5 USD1_A8        SD_DQ10        SD_DQ26
    ' `3 \8 K7 d' p+ fSD1_A9        SD_DQ11        SD_DQ27
      r9 a& ?. d( \8 C( J" W& uSD1_BA0        SD_DQ12        SD_DQ28
    # C9 y# U  v# A9 Q" a9 ZSD1_BA1        SD_DQ13        SD_DQ29
    " M; I; m! h7 s8 d" J: p4 D! GSD1_BA2        SD_DQ14        SD_DQ30
    $ h& c  Q* x8 T  JSD1_CAS#        SD_DQ15        SD_DQ31
    % v$ d. Z( ~& d  f, J0 dSD1_CKE        SD_DQS1-        SD_DQS3-
    8 ]" S5 u  ~9 d* N* ySD_CLK0-        SD_DQS1+        SD_DQS3+4 G' }& T/ r, e3 B* K; `! G
    SD_CLK0+               
    2 ~8 |5 j/ f' f0 D: M4 W7 _5 w! QSD_CLK1-               
    ) w+ A. @( ~: l; @3 a% KSD_CLK1+               
    ; E) h) @' V, @8 l- ]SD1_CS#                % ?0 ?: P3 S4 E7 n/ I8 H3 ?
    SD1_ODT                / C5 d+ s# s/ W* _
    SD1_RAS#               
    ) c! X* {# M% F; ~  TSD1_RESET#                0 P5 ^7 ?- p7 w$ e
    SD_STBC_CKE                5 r8 i. _% [+ r$ K; I' i" t* S
    SD1_WE#               
    / u2 u2 x6 G& d$ L

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    2#
    发表于 2012-11-21 19:12 | 只看该作者
    1、时钟线和地址线设为一组,并且等长要以时钟做参考
    - |7 c  u: R5 v: v5 K2、等长公差的话随着速率的提高要依次减少,ddr3的公差可以控制在15mil
    ' O9 k: {" z/ v  `; U3、数据线和地址线要完全取分开,不能交叉走线

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    3#
     楼主| 发表于 2012-11-22 11:20 | 只看该作者
    谢谢!还有一些控制线,如DM,DQ......,这些控制线是跟数据线还是地址线在一组呢?地址线要以什么信号线为参考呢?

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    4#
    发表于 2012-11-22 11:52 | 只看该作者
    love365 发表于 2012-11-22 11:20 / \% h& |9 ^! }2 [2 J
    谢谢!还有一些控制线,如DM,DQ......,这些控制线是跟数据线还是地址线在一组呢?地址线要以什么信号线为参 ...

    # @1 ?3 r* E4 e& d, a4 Fdqs、dqm是要和数据线分为一组,其余的像we,cs之类的就归到地址组,地址组的等长以时钟线为参考

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    5#
    发表于 2012-11-27 23:04 | 只看该作者
    同求

    该用户从未签到

    6#
    发表于 2012-11-28 01:33 | 只看该作者
    tomyqg 发表于 2012-11-27 23:04
    * \3 ~# S$ P( l2 }) S同求

    0 m, ^9 N( ^; t' o; U1 V0 v多看看intel公司主板设计指引,上面分组讲得比较清楚

    该用户从未签到

    7#
    发表于 2012-11-28 11:00 | 只看该作者
    andyxie 发表于 2012-11-28 01:33 ( ~0 c* I  K: t1 b1 W3 m+ L# c
    多看看intel公司主板设计指引,上面分组讲得比较清楚
    6 L( L3 @: L3 Y- A' w/ i; w
    andyxie  能发一份到  LEESE2002@163.COM 吗?谢谢!

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    8#
    发表于 2012-12-4 23:22 | 只看该作者
    新人学习!!

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    9#
    发表于 2012-12-6 08:34 | 只看该作者
    andyxie 发表于 2012-11-28 01:33 ! @( T0 K  a1 @: }) e
    多看看intel公司主板设计指引,上面分组讲得比较清楚
    ; H" [) y5 u6 Q# D
    求大侠也给我发一份吧。邮箱:237564880@qq.com

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    10#
    发表于 2012-12-6 08:48 | 只看该作者
    andyxie 发表于 2012-11-28 01:33
    4 x! d  N# J# G# B7 _多看看intel公司主板设计指引,上面分组讲得比较清楚

    , s) h% x7 W$ k) W同求大侠发份,邮箱:675609122@qq.com,谢谢~!

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    11#
    发表于 2012-12-7 21:42 | 只看该作者
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    4 c+ F8 f" k. s' A! T! ~https://www.eda365.com/thread-80582-1-1.html
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