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有用ECO To PCB 从原理图导PCB的请进

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1#
发表于 2012-9-8 13:18 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
pads Logic上有一个电容元件CAPACITOR,里面设了两个PCB封装:3216和6032C,如图一
4 n" F6 g$ @' k7 W& V0 `1 k1 q ' b+ m) ]6 S: l6 U8 e6 O7 g# `! V& q, \% u
某张原理图用到了两个CAPACITOR元件,其中一个元件C181将PCB封装设为3216,另一个C108设为6032C,如图二、三- p& x, ]; z/ ]8 g% }1 ]1 G4 c( x

$ m4 K; A. [" |生成网表,可以找到两个PCB封装指定语句:+ ?; l; n5 A, [) c* t) @
C181    CAPACITOR@3216
9 o) M6 W7 _0 u( [4 s* T+ nC108    CAPACITOR@6032C
3 ^' z( ~  W5 c* y" |: b在PCB上导入这个网表,生成的两个元件封装完全正确:一个是3216,另一个是6032C
* b3 x. Q/ [5 H5 \8 C2 b4 r+ u  V  b' W) C, ]2 [' X- n! F! L
现在的问题是,我不用导入网表的方法新建PCB,而是用logic上的“ECO To PCB ”功能新建PCB,如下图
( t& X3 ^1 a( n. ]
* v5 e1 g, O! B& q/ u8 }6 K生成的PCB文件两个元件的封装都是3216,另一个则需要手动去修改,如图
# k& p; J: H; q# ^; B2 i8 u # b4 Z" r4 v2 }% @! x
是ECO哪个地方设置有误导致要手动指定而不是自动生成?

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2#
发表于 2012-9-8 13:43 | 只看该作者

( P! w$ ]) `- z& Q$ m* T% t6 v) `* y不知是不是这里

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3#
 楼主| 发表于 2012-9-9 11:22 | 只看该作者
谢谢楼上! 在这个选项打上勾就可以了;
( p# E" I; b) s4 h8 x- o7 O- c应该PADS logic在用ECO的时候没去检查封装,而导网表则会去核对封装。

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4#
发表于 2012-9-11 15:36 | 只看该作者
:xuexi
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