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学习pads时踩过的坑——如何检查 Stub 线? / w! [* D, i& Y# ^$ i0 d% F
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* V0 M; {; U$ _- j作为一名优秀的PCB设计师,他所设计出来的PCB应该是无可挑剔,包括前端的PCB布线和后端的DFM(面向制造的设计,Design for manufacturability);因为设计与制造是产品生命周期中最重要的两个环节,并行工程就是在开始设 计时就要考虑产品的可制造性和可装配性等因素。1 ~! ~) ]! v! J" z2 d d
! v" I+ J- N7 y8 F T7 _此份简明教程将以图文的形式展示如何帮助您快速和准确地进行 DFM 检查和优化 Stub 线。$ L r3 `: w5 q H
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一、何谓 Stub 线
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! m& p: ~- ]' M# {; w9 _就是俗称的线头或歪线(特别在 Router 中经常出现), 或者说信号没打算经过的路径,如图所示:
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& z" L c9 B+ k" j% C但是以下两种情况是可以忽略的:# [6 V# y$ ]" A, g- W
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1, 在添加测试点的时候,为保证测试点的间距,不得不多拉一根线出来。
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0 y0 J! s* t2 w这种情况,对于 High speed signal 是完全禁止的。因为通过大量的仿真和布线经验,stub 会严重影响高速线的信号质量。
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- \# c' Y! Q/ ?# r) ^' b5 ]% d& [2, 对于 press fit component 而言的,当板厚在 2.1mm 以上时,并且 信号是在上半部分层面进入 press fit component ′s pin 的时候,就产生了 via stub.7 ?% u3 N( E5 n" r& b
! N2 U/ N( D# U, g7 Y: t比如,一个 16 层板,信号在 Layer3 进入 press fit component ′s pin,则红色路径为信号经过的路径。蓝色路径就是多出来的 Stub。
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此种情况也会影响高速线的信号质量的。! h& y: ^5 }* i4 f ]7 _. j
) M' O& {. O, O w解决方法:
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6 o4 G7 \% @& G7 l5 c一是将蓝色的线切掉,就是要求 PCB 进行背钻处理。上图 背钻从 bottom 钻到lay4,但这会增加很多成本。
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1 C3 m- J0 a, o二是信号线尽量往下半部分层面如 press fit component ′s pin。
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信号对 stub 的长度也是有限制的,这就需要根据信号的速度而定。可通过仿真或直接咨询信号完整性工程师.
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! B8 A3 j$ Y8 Q0 n. w' e二,Stub 检查
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% k8 W9 P& a4 p5 h- t1、执行[Toosl]/[Verify Design],进入设计验证界面.5 v( x% r9 X) _* K' F
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2、执行[Hign Speed],进入高速设计验证界面.
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4 z. d& e6 q6 N3 N) U' L( @, O3、勾选[Check Stubs]/[OK]
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) ]/ E( G8 g$ B; {; O6 s% [+ F4、执行[Start],进行 Stubs 验证。
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; n- y+ A' }& e( p, {' k7 c& o4,此时,在我们的 PCB 上面,会出现警告标识,我们可根据警告标识进行布线优化.3 N1 u" q% U3 e- K
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