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[Cadence Sigrity] speed2000 Generator仿真DDR3控制器加载IBIS模型提示无电源端口

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  • TA的每日心情
    奋斗
    2023-7-11 15:12
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    [LV.1]初来乍到

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    1#
    发表于 2019-5-29 00:40 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    各位好,第一次碰到speed2000 Generator仿真DDR3控制器加载IBIS模型提示无电源端口,看了下speed2000没有把该PCB上的CPU控制器的电源脚导入,同项目的内存颗粒无问题。换了另一个板子的CPU与DDR都没问题。+ @6 m* V! B% {  w/ o- A
    + K7 w  p# w& ?" ?

      M/ G% a, p; [3 ^- U( B

    捕获.JPG (14.62 KB, 下载次数: 1)

    导入提示无电源引脚

    导入提示无电源引脚
  • TA的每日心情
    奋斗
    2023-7-11 15:12
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    [LV.1]初来乍到

    推荐
     楼主| 发表于 2019-6-2 10:51 | 只看该作者
    CPU与DDR虽然都是1.5V供电,但是是采用2个不同的电源芯片供电,CPU的电源网络net是1.5V_mcu,DDR的电源网络是1.5V_ddr,speed2000在提取CPU与DDR的模型时,如果把1.5_mcu与1.5V_ddr都改为1.5V 电源net,如1.5V,再提取模型时MCU与DDR都没有问题,但是如果是2个独立的net就有问题。肯定与IBIS模型没关系,因为还没有到加载IBIS模型的步骤,speed2000在仿真时难道需要MCU与DDR的电网的net必须是一个?但有时MCU和DDR会是独立的电源芯片供电,软件难道没有考虑这种情况?
  • TA的每日心情
    奋斗
    2023-7-11 15:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    推荐
     楼主| 发表于 2019-6-2 17:46 | 只看该作者
    如果cpu与ddr是同一个电源net就没问题,经过几十次试验了,影响后面电源引脚的地方,就是图中的地方,此处选择为DDR颗粒部分的参考电源,如果此时CPU与DDR同一个net就没问题,但是如果是不同的net就会出问题,因为参考的是DDR的电源。难道,还有别的地方设置?其他地方多次试验的没关系

    捕获.JPG (37.01 KB, 下载次数: 1)

    捕获.JPG

    该用户从未签到

    推荐
    发表于 2022-9-11 15:31 | 只看该作者
    $ w- ~! K; Y1 L; i
    借宝地提供问题,我这所有都设置完了运行仿真时提示CLOCK P信号:The simulation stopped because V(X_U11.K7, X_U11.K1) has value '-1.95621e+14 V' at time '0 ns'. The amplitude of this signal exceeds the blowup limit '1e+09 V'
    ) ^2 P" b9 ^- Z# ]9 C/ I! T是不是因为实际原理图端接到GND的原因?
    6 ]; g8 o. {9 [# C6 A. v7 d- q/ t" h7 Y) \; E4 R3 l. ~

    该用户从未签到

    5#
    发表于 2019-5-30 20:52 | 只看该作者
    这个不是颗粒问题,是在定义电源的时候没有定义到DDR系统的电源,比如VCC1V5,这个网络连接到BGA的引脚,系统会自动识别匹配power然后和IBIS模型对应连接,如果没定义,或者定义错了就不行。

    点评

    好像有的模型需要自己修改才可以  详情 回复 发表于 2019-6-1 17:33
  • TA的每日心情
    奋斗
    2023-7-11 15:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    6#
     楼主| 发表于 2019-5-31 12:38 来自手机 | 只看该作者
    虽然控制器和内存都是1.5V,但是是不同的电源网络,比如VCC1V5-CPU,VCC1V5-DDR,设置了ddr的参考电源,能识别到内存颗粒的电源,但识别不到cpu的,如果cpu与内存电源net是同名的话,没问题,又没有方法或思路绕开这个同网络的限制?
  • TA的每日心情
    奋斗
    2023-7-11 15:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    7#
     楼主| 发表于 2019-5-31 12:43 | 只看该作者
    麻烦再瞅瞅,谢谢

    “来自电巢APP”

    该用户从未签到

    8#
    发表于 2019-6-1 17:33 | 只看该作者
    kevin890505 发表于 2019-5-30 20:52$ @) U2 K4 x3 a' L! Q# ^
    这个不是颗粒问题,是在定义电源的时候没有定义到DDR系统的电源,比如VCC1V5,这个网络连接到BGA的引脚,系 ...

    - ]: r- b, S0 O5 @6 s: Z好像有的模型需要自己修改才可以
  • TA的每日心情
    奋斗
    2023-7-11 15:12
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    [LV.1]初来乍到

    9#
     楼主| 发表于 2019-6-1 19:01 | 只看该作者
    bingshuihuo 发表于 2019-06-01 17:33:265 _* U5 u+ D1 y& P5 R8 Z: s4 B/ E
    [quote]kevin890505 发表于 2019-5-30 20:525 [( R& A! u4 i" H% n/ G
    这个不是颗粒问题,是在定义电源的时候没有定义到DDR系统的电源,比如VCC1V5,这个网络连接到BGA的引脚,系 ...
    8 V( h# K& ]+ _2 V
    好像有的模型需要自己修改才可以[/quote]# w+ R$ m5 M/ X
    , G4 E+ W4 S1 ^5 u1 }0 k7 ?. ^
    这个不是模型的事????
    ) c3 r5 P9 t, g. T3 G

    “来自电巢APP”

    点评

    不排除,IBIS模型什么千奇百怪错误貌似都可能,如果定义对了没用那可能就是模型调错了,对不上号,或者模型没定义power之类的  详情 回复 发表于 2019-6-1 22:16

    该用户从未签到

    10#
    发表于 2019-6-1 22:16 | 只看该作者
    wsn2010 发表于 2019-6-1 19:01: p3 J9 ?1 U) ~
    好像有的模型需要自己修改才可以
    + `7 O/ T4 [$ I
    + G2 ~* e: k0 y7 U, E6 s: n# I: K
    这个不是模型的事????[/quote]
    $ V& S. e, P0 F1 N' T
    9 t3 q' E5 H* n! _- I* ~3 S( Z不排除,IBIS模型什么千奇百怪错误貌似都可能,如果定义对了没用那可能就是模型调错了,对不上号,或者模型没定义power之类的
    " q9 ~& b& N) M7 S3 F
  • TA的每日心情
    开心
    2026-4-13 15:08
  • 签到天数: 803 天

    [LV.10]以坛为家III

    12#
    发表于 2019-6-2 11:37 | 只看该作者
    整个过程,需要根据教程一步一步的进行设置。看提示,应该是缺少了设置。
  • TA的每日心情
    无聊
    2025-5-22 15:56
  • 签到天数: 256 天

    [LV.8]以坛为家I

    15#
    发表于 2019-7-18 17:21 | 只看该作者
    你可以把这两个电源网络合并为一个网络,就如同0欧电阻两端信号处理方式一样,这先要将两个电源变为信号,再进行合并网络
    ' `8 A! u. c6 ?' z9 l# s$ C, t) w[img]
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