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怎么修改导线的属性?

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1#
发表于 2011-10-1 15:31 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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allegro中,我把地分成了模拟地和电源地。因为设计原理图时候忘了把他们相连,所以在orcad中修改,把它们相连了;后来导入到allegro中,所有地网络变成了电源地,那么原来两种不同颜色的导线成了一种颜色,我觉得不太方便,那就又在原理图里面把电源地与模拟地分开了,之后导入allegro中,后来发现出现了很多DRC。而原本的模拟地的导线显示成电源地的导线。我想把drc消灭,怎么办?求救。

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2#
发表于 2011-10-1 17:25 | 只看该作者
即然连了,就是同一个网络啊.肯定分不出颜色吧? 又把它分开了,你意思是,布好线再把它们相连?

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3#
发表于 2011-10-1 17:29 | 只看该作者
本帖最后由 longzhiming 于 2011-10-1 17:32 编辑 % s2 R. ?9 @( a3 A! i: [! \# v* K

" |5 P8 g* z' q好像软件还没那么智能,要有,那就好了,因实际应用中确实不同的地通常连在一起的. 而这样在PCB中颜色不能分开来显示啊,除非用个元器件隔起来. 要不怎么办? 请楼下高手给答案.

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4#
 楼主| 发表于 2011-10-1 18:25 | 只看该作者
本帖最后由 catking5252 于 2011-10-1 18:28 编辑 4 a  o' |8 q; z& ]0 S( R
longzhiming 发表于 2011-10-1 17:29 9 M! c8 S( l2 `' }
好像软件还没那么智能,要有,那就好了,因实际应用中确实不同的地通常连在一起的. 而这样在PCB中颜色不能分开 ...

5 V0 F. W% R' E2 L0 ?$ O7 h6 S  Y4 J4 \/ \- D# h
不好意思,我讲得不清楚。不是把颜色分开,而是,我在orcad中把模拟地和电源地连在一起后,加载到allegro中,然后又在orcad中把模拟地和电源地断开连接。再加载到allegro中,之后就有DRC错误。我在allegro中把模拟地和电源地的连线断开,依然有drc错误。想请教怎么消灭这些drc错误?

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5#
发表于 2011-10-1 19:20 | 只看该作者
catking5252 发表于 2011-10-1 18:25 . g- t( y$ L/ J3 C
不好意思,我讲得不清楚。不是把颜色分开,而是,我在orcad中把模拟地和电源地连在一起后,加载到alleg ...
* c# r; B( f7 H) o3 \( Y
在tools菜单里有啊

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6#
发表于 2011-10-1 19:21 | 只看该作者
Update DRC

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7#
发表于 2011-10-1 21:42 | 只看该作者
在原理图中并不知道FG或GND放在哪,你这样不断的改,当然会出现应当FG的地方变为GND,如果你想修正,建议从PCB中直接修改shape为FG就可以了。

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8#
发表于 2011-10-1 21:44 | 只看该作者
你可以详细看一下DRC的说明再对症下药

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9#
 楼主| 发表于 2011-10-1 22:53 | 只看该作者
dbit 发表于 2011-10-1 21:44
; d8 @( K+ D8 \, b% [1 \$ G你可以详细看一下DRC的说明再对症下药

9 C5 s* K6 v" L9 X' v4 D呀,终于有大侠明白我意思了。但是还是不懂怎么改。- q" o8 }/ W9 Q& }2 I) j
错误如下。
+ U, O# Q2 r+ s4 I/ c4 \% ?) I  < DRC ERROR >           
% @$ r+ P2 _) q( V- E0 Z5 @* X0 Y( F$ y6 _/ \+ d' u' ~* a/ `
  Class:           DRC ERROR CLASS
# m" d/ E& }) ?4 G  Subclass:        BOTTOM- y& C: ?1 Y  j& q0 _& f& Z
  Origin xy:       (-833.54 -2264.18)4 Z7 D$ R/ s% J0 d" g  G
  Constraint:      Line to Thru Pin Spacing! h: e4 F$ I: ?& h
  Constraint Set:  DEFAULT& k  w4 P& g7 K' _3 Q" Y6 [4 M! `( y& [
  Constraint Type: NET SPACING CONSTRAINTS
+ X! f4 I( C- R, Z
  ~. H! B& `9 o6 K  Constraint value: 11 MIL0 X+ y* `  @0 u
  Actual value:     0 MIL
' \% s0 ]3 L8 G% X0 v( T+ `- K6 C1 Y$ F
  - - - - - - - - - - - - - - - - - - - -- ]) \. {/ S( k' Q/ U' R9 t# E' j
  Element type:    SYMBOL PIN# j2 d8 {5 a! z% F1 V1 \+ B: Z* Y
  Class:           PIN
5 j4 t( ?# R! S& u8 E
$ f- h; `( _' X- b: K% |+ P  PIN:          R26.2
  E/ H; O* y- F7 Y" z  pinuse:       UNSPEC
" |, ^3 N9 a  }% M3 V. D2 x  location-xy:  (-856.52 -2287.16) 1 s/ a, k& j  ^+ q) r
  part of net name:  GND_SMALL_SIGNAL+ l; f% G6 ^, z7 v3 ^$ E
  - - - - - - - - - - - - - - - - - - - -- ^6 p2 [% ^, N( G. Q; E# A
  Element type:    ODD-ANGLE LINE SEGMENT
; s) a0 H3 W9 Z( z5 ^7 m2 i( z  Class:           ETCH
- Z2 ^& Z8 I9 ]9 m9 H  Subclass:        BOTTOM( j  T0 q4 U7 a) j8 d. `+ g

) O6 r1 g, ^' R/ f  part of a connect line6 `+ t8 s7 _2 b- O1 d
  Not on a Net
/ W" B; Z# O  K. \3 U0 G: W9 v; g0 n: m
% p: @2 g1 X' E% o+ _7 c- s1 {
我发觉错误的地方都是NOt on a Net。但我怎么修改导线的属性,令到它是我要的网络呢?例如我本来是模拟地,相连后,变了电源地,再改,模拟地就出错了,但电源地就无问题。求大侠指教

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10#
 楼主| 发表于 2011-10-1 22:54 | 只看该作者
dbit 发表于 2011-10-1 21:42   b$ _* s: h7 s1 p
在原理图中并不知道FG或GND放在哪,你这样不断的改,当然会出现应当FG的地方变为GND,如果你想修正,建议从P ...

0 }0 @: |9 d, w' G小弟新手自学。地不是shape,是导线来的。怎么改导线FG为GND呢。

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11#
发表于 2011-10-3 11:52 | 只看该作者
DRC 描述是pin 和线 gap太小,是0,在16.3下,/ h  ]/ M8 J% h* h& S
1.allegro的linsence功换到SI模式(在file下的change editor),
" Q) Z& N4 y5 w3 u2.在logic菜单下有edit nets,点你想修改的网络就可以

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12#
 楼主| 发表于 2011-10-6 22:16 | 只看该作者
dbit 发表于 2011-10-3 11:52
. v$ o5 o/ s1 `' DDRC 描述是pin 和线 gap太小,是0,在16.3下,
6 _& o$ U) a& m; s1.allegro的linsence功换到SI模式(在file下的change editor ...
/ G# n$ K# ]+ X, |3 ]" [
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