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allegro 17.2 怎么建立Xnet

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1#
发表于 2017-8-5 15:34 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
15金币
本帖最后由 tiny丨Y 于 2017-8-12 10:28 编辑 : o7 k2 s0 j) s! }, `* i

; S0 X) q. z9 f$ z9 G问题如题我不是小白  v1 l& A3 z0 g% \
用signal model assignment方法试过了,建立失败
; [% \6 d, ^/ d2 ?2 l请用17.2试过成功的大神帮忙解决
! t; Q6 b8 C  w" z版本17.2 S0942 ^8 R# T( K  r/ z0 E+ L& W3 W9 W
感谢rock_li29的帮助:可能是你的BRD文件数据有问题,提示电源和地网络有问题,重新开一个新的BRD file,把现在的器件,走线,铜皮贴到新的BRD文件可以设XNET.
/ h4 r0 D( r/ W. r( c* A$ M. ^7 b: N6 \! v/ ?! w' Y4 A8 l
6 r1 O9 c0 V! `- y1 X6 Y: H4 I
已确认解决,但还是没找到为啥 原来的brd不能设置 继续求助# k; Q; {4 d5 c+ F( i

最佳答案

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附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。

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2#
发表于 2017-8-5 15:34 | 只看该作者
tiny丨Y 发表于 2017-8-7 09:44! K- r  x& \- v6 i
方便加个QQ2542796636 附件不好上传
  F8 W" U- v7 L
附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。
+ w8 E. I1 }2 W  S. O

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附件  详情 回复 发表于 2017-8-8 14:45

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3#
发表于 2017-8-6 17:59 | 只看该作者
没有用过17的版本

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4#
发表于 2017-8-7 09:18 | 只看该作者
17.2的补丁已经到094了吗?

点评

057吧  详情 回复 发表于 2019-8-7 13:14

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5#
发表于 2017-8-7 09:33 | 只看该作者
跟16.6的方法是一样的,可能是的BRD文件有问题,方便的话可以把BRD文件附上来帮你看看。5 D; }. Y) x: D& O& ~

xnet.png (47.96 KB, 下载次数: 11)

xnet.png

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方便加个QQ2542796636 附件不好上传  详情 回复 发表于 2017-8-7 09:44

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6#
 楼主| 发表于 2017-8-7 09:44 | 只看该作者
rock_li29 发表于 2017-8-7 09:337 H  \) q5 {0 w6 j1 e: Q
跟16.6的方法是一样的,可能是的BRD文件有问题,方便的话可以把BRD文件附上来帮你看看。

1 b# ?2 g& D9 q# F. G7 C3 v方便加个QQ2542796636 附件不好上传

点评

附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。  详情 回复 发表于 2017-8-8 10:14

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7#
 楼主| 发表于 2017-8-8 14:45 | 只看该作者
本帖最后由 tiny丨Y 于 2017-8-8 15:01 编辑
% ^: R3 m) L7 ]
rock_li29 发表于 2017-8-8 10:14, S' i/ |3 A8 L
附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。
" h0 ?* R- u5 {6 ~+ I
私信你了

pcb.zip

1.22 MB, 下载次数: 32, 下载积分: 威望 -5

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8#
发表于 2019-8-7 13:14 | 只看该作者
zuoanwind 发表于 2017-8-7 09:18, D- p, w( ^6 }; E
17.2的补丁已经到094了吗?

: \6 c. Q  w" b5 C* {057吧
) i+ z, P  ?7 y* m* p* |

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9#
发表于 2019-8-8 05:59 | 只看该作者
17.2的问题。

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10#
发表于 2019-8-8 06:07 | 只看该作者
不方便截图,这是新找到的,是17.2的问题
* h+ h$ Z" r& {( B5 L  \
7 f! X1 O! S  m3 @  {1.Close the design if it is open in Allegro PCB Editor.; V# ^+ B- [6 T/ \
2.Add the CDS_XNET_STATE_UI variable​ with a value of 1 to the User variables section in the Environment Variables form.5 v. Y: S5 O) ~- l# i
3.Open the design in Allegro PCB Editor.
" [2 I1 ^% T/ d1 P$ c4 y3 z4.Go to File > Import > Logic and, if not already set, set the Import Logic Type to Design Entry HDL.
- t9 d" k, b9 J. f5 P- X9 `5.Open Constraint Manager.  V8 U3 t/ W, i0 W/ Y3 k7 H  f6 G
6.Select Tools > Options.5 s! {- d- D  j5 O* n. H1 ]  s5 v
7.Select the Create XNets and Differential Pairs using DML Models (same as SPB 16.6) option.
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    2022-11-28 15:00
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    [LV.1]初来乍到

    11#
    发表于 2019-10-28 11:40 | 只看该作者
    今天我也是遇到了,17.2不能创建XNET。。。
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    12#
    发表于 2019-10-28 11:45 | 只看该作者
    版本17.2 S094  能分享下S094的补丁?

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    13#
    发表于 2019-10-28 19:55 | 只看该作者
    試試.謝謝!
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    14#
    发表于 2020-3-13 11:44 | 只看该作者
    THANK YOU.
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    15#
    发表于 2020-3-17 13:41 | 只看该作者
    谢谢分享
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