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chenqinte · 发表于 2009-4-14 08:28

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本帖最后由 chenqinte 于 2009-4-15 21:37 编辑

帮我解释下这两张图,谢谢

forevercgh · 发表于 2009-4-14 09:35

兄弟，你的图在哪？？？

liqiangln · 发表于 2009-4-14 17:20

晕倒，请把图转过来。

cherry5767 · 发表于 2009-4-14 23:05

哈哈

chenqinte · 发表于 2009-4-15 21:37

图已经上传了,不好意识啊

wakinoda · 发表于 2009-4-16 12:29

解释硬件原理？这个可以查FPGA的手册

chenqinte · 发表于 2009-4-16 16:21

在实际设计中,按照上面标准的画法设计的话,输出的信号不理想;把50ohms的上拉电阻换成36ohms结果就行了.我想问的问题就这个,为什么会这样.上次信号的频率是1.25ghz.这次我们打算做2.5ghz的,这时碰到上拉电阻不知如何确定的问题了.上次是成品板做好后,通过硬件调试才ok的,这次想在软件仿真中就解决这个问题,我用的方针软件是hyperlynx

wakinoda · 发表于 2009-4-16 17:27

首先回答为什么：其实就是termination的选取造成不同的反射影响SI。
不过我有两个问题，针对你的描述：
1.你所说的50Ohm上拉根据图里来看应该是internal source termination，你们是通过寄存器改变Driver内部的电阻？
2.Hyperlynx我接触的很少，不过据我所知它是有sweep功能的，尤其碰到这种匹配难以抉择的情况最适合用这个功能。不知道LZ有没有尝试过？

forevercgh · 发表于 2009-4-16 18:21

hyperlynx有sweep？？？
SQ貌似可以sweep

chenqinte · 发表于 2009-4-16 18:29

本帖最后由 chenqinte 于 2009-4-16 18:45 编辑

50ohms的上拉电阻,我们接在外面的,可以通过更换电阻就可以实现.原因可能是我们的器件内部没有集成.还有你说的sweep我还没用到过,hyperlynx是我自学的,怎么用还得向你请教.我有在用terminator wizard来选着端阻抗.不过这版本对上拉这种端接方法不能分析,也是继郁闷.我还有个问题就是在我仿真时,在选中其中一对差分线时,差分线中会出现虚线,请指教是出了什么问题.图在下面.

chenqinte · 发表于 2009-4-16 18:32

本帖最后由 chenqinte 于 2009-4-16 18:48 编辑

wakinoda · 发表于 2009-4-17 08:30

是的，SQ也可以sweep，但我觉得没有hyper的好用；不过我是最近看到8.0版本，以前的版本不是很清楚有没有sweep，但termination recommendation是有的。

hyperlynx有sweep？？？$ J; W" @ b4 ~+ ]! {2 R% n- J- z5 z) p
SQ貌似可以sweep
# S% s1 U4 M# Vforevercgh 发表于 2009-4-16 18:21

wakinoda · 发表于 2009-4-17 08:33

50ohms的上拉电阻,我们接在外面的,可以通过更换电阻就可以实现.原因可能是我们的器件内部没有集成.还有你说的sweep我还没用到过,hyperlynx是我自学的,怎么用还得向你请教.我有在用terminator wizard来选着端阻抗.不过 ...& _4 ?; \2 R6 w# x0 ~
chenqinte 发表于 2009-4-16 18:29

不敢说请教，我对Hyperlynx的了解恐怕不比你多。我所知道的是基于新发布的8.0版本是可以进行sweep仿真并结合wizard找到你想要的电阻值。
希望有Hyper的高手来看看

chenqinte · 发表于 2009-4-17 09:18

你有8.0版本的hyperlynx,那我去下一个.不知道能不能计算出来.还有虚线的一些问题,请大虾指教

liqiangln · 发表于 2009-4-17 10:05

我简单介绍一下原理，CML那边是不需要上拉电阻50欧姆的，你看他图上画的上拉电源的名称，就知道那是内部电源。
LVPECL电平，有2个特点就是需要直流偏置和电压嵌位。所以在做输入的时候需要电压嵌位(VCC-1.2V),所以通常是82/133电阻分压，同时戴维南原理等效50欧姆阻抗。
而在输出的时候需要直流偏置，因为是射级输出，你没直流回路，就没电流了。所以一般下拉100～200欧姆的电阻。

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