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[HyperLynx] DDR仿真网络选择

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发表于 2018-1-11 17:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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使用DDR仿真的时候,选择数据网络的时候为何DQ/DM分一起,见图中箭头处。是哪里出错了,如何改正?求教# X/ E6 p3 Q# K& @; T3 @* x0 D; v

2018-01-11_17-24-33.jpg (189.53 KB, 下载次数: 6)

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2#
发表于 2018-1-13 10:32 | 只看该作者
前面网络那一步没有问题吗?, C/ k1 q$ x2 h) Z, ?$ i
5 l% H) l; P1 P: H+ V. U. q

点评

没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。  详情 回复 发表于 2018-1-15 10:26

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3#
发表于 2018-1-13 14:58 | 只看该作者
参考差分的形式,你的模型是不是有问题?定义了差分?

点评

有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?  详情 回复 发表于 2018-1-15 10:29

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4#
 楼主| 发表于 2018-1-15 10:26 | 只看该作者
superlish 发表于 2018-1-13 10:32: c7 Y+ y0 h4 u, ^& c8 f  k
前面网络那一步没有问题吗?

! c2 J* V" z6 Q* B没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。
5 v, X0 x/ x: _, l7 i8 ]

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5#
 楼主| 发表于 2018-1-15 10:29 | 只看该作者
GHOST 发表于 2018-1-13 14:58
8 z9 P$ D1 y* r4 l  [+ J8 x5 v参考差分的形式,你的模型是不是有问题?定义了差分?
7 u0 ?; w- X8 E& f. A  l
有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?1 B5 m) A$ B/ E

点评

直接打开就可以看啊  详情 回复 发表于 2018-1-15 11:53

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6#
发表于 2018-1-15 11:53 | 只看该作者
dhgchina 发表于 2018-1-15 10:29
' c9 n, L7 i: _% B: C, y有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变 ...

% _0 X* |5 {1 F直接打开就可以看啊
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点评

问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了  详情 回复 发表于 2018-1-15 20:27
打开看没问题啊,有什么解决办法没有?  详情 回复 发表于 2018-1-15 17:13

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 楼主| 发表于 2018-1-15 17:13 | 只看该作者
GHOST 发表于 2018-1-15 11:53) g( e% }6 i# [  J2 W' ^/ h+ L/ Q
直接打开就可以看啊

8 B' {6 x0 |/ Q3 n" \$ `1 ^# W打开看没问题啊,有什么解决办法没有?' g4 G. r: ~* n$ X

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 楼主| 发表于 2018-1-15 20:27 | 只看该作者
GHOST 发表于 2018-1-15 11:53# s4 Z" w8 S$ F* _( d( @
直接打开就可以看啊
& i" w4 W# O* v( j
问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了
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