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[仿真讨论] [求助] sigrity中的 trace 和 shape

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1#
发表于 2015-12-24 13:40 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位,
, B9 z* i% P. ^1 p7 i  o4 s) R% b/ ^. b3 E
   (1)sigrity软件是对待trace和shape的 (分别是怎么建模的)?
* W2 ]0 _5 l( \9 l/ ?* F* Z8 A. M- f   (2)在DC drop中,trace和shape是同等效果的吗?
) p( B- d7 m. n/ Z& I( Y1 L9 i

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2#
发表于 2015-12-24 14:07 | 只看该作者
我所了解的信息,供参考:( b, B9 L% p0 l% ^* ]  s
1.sigrity导入pcb设计文件会区分trace和shape,这个是传输线类型的建模。算法上,trace采用BEM+FEM,shape采用BEM,过孔采用局部FEM,所以高频下trace的准确度要高于shape,低频下shape的准确度要高于trace。但不管什么算法,碰到不连续的传输线结构,这种2.5D的软件在精确度上都会有所欠缺。1 b6 t' d1 b0 d  Z$ ^& C
2.DC drop是静态的分析,trace和shape等效。- m: a! ^+ {; ~8 w$ f; F( \1 B

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3#
 楼主| 发表于 2015-12-28 14:25 | 只看该作者
本帖最后由 l888888h 于 2015-12-28 14:35 编辑 2 l3 w! [5 ]0 J1 q
8 n) D9 l: P. K& c- Z
谢谢
* T$ P5 C9 F) H9 v7 x+ ~3 K0 Z) `' H  \& m5 F$ t
  遇到了一个问题,一个小power(用trace连接的)在做DC drop的时候,用半成品的PCB文件(只处理了电源部分,其它部分是空的)时,仿真出% |  z6 U( @, M* v" A$ S. \
的结果是错的(得出的阻抗太小了,明显是错的),将trace转换为shape后,得出的就结果正常了
4 X2 t6 y0 J) j( i  等整个PCB全部完成后(电源部分,信号线部分都完成了),再次仿真,结果又正常了(依然是用trace连接的)
0 f0 S0 J" A3 F$ h7 I7 ?: d/ S. H- f

点评

你这种神奇的问题我也遇到过,没找出原因  详情 回复 发表于 2015-12-28 14:50

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4#
发表于 2015-12-28 14:50 | 只看该作者
l888888h 发表于 2015-12-28 14:25) E7 A7 _  U  V7 v1 M+ e7 k4 c
谢谢
2 d0 j- {% `* l) O& `; d0 l2 H! L, ]: ^4 v6 d5 m5 J
  遇到了一个问题,一个小power(用trace连接的)在做DC drop的时候,用半成品的PCB文件(只处理了 ...

6 f; {) ?- v- k- j5 ~9 J* q你这种神奇的问题我也遇到过,没找出原因
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