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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › Sigrity组件中SPEED2000仿真DDR3报错
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[Cadence Sigrity] Sigrity组件中SPEED2000仿真DDR3报错

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aaaaaaaa1111

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1#
 楼主| 发表于 2023-12-20 21:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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求助用Sigrity中的SPEED2000仿真DDR3报错如下错误! \- b2 R5 ]7 ]7 `
Error 4040: X_pin defined in circuit SpeedXP_auto_XC7K325TFFG900_FFG900_(S1+S2+S3+S4+S5+S6+S7+S8+S9+S10+S11+S12+S13+S14+S15+S16+S17+S18+S19+S20+S21+S22+S23)_XC7K325TFFG900_XC7K325TFFG900_KINTEX7 has 3 nodes, subckt PinModel_U21_U21 has 9 nodes.
% ^$ l+ h5 W7 ]+ p& H. z6 t+ RSimulation failed.
' g6 m" o9 ?/ D& i/ _" _9 T% T0 S6 h. J. r  _
想请教一下这是什么原因，应该从哪些地方排查9 h( i& v/ C. {$ C% \) ?

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狂羁青马

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2#
发表于 2023-12-21 10:00 | 只看该作者
可以分享一下你的K7模型吗，邮箱xinbadawork@163.com

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aaaaaaaa1111
不知道是不是我的模型不对导致这个地方报错  详情 回复 发表于 2023-12-21 10:09

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狂羁青马

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3#
发表于 2023-12-21 10:01 | 只看该作者
感觉是net没匹配起来

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aaaaaaaa1111
是我选择的net吗？我为了验证只选择了三条net  详情 回复 发表于 2023-12-21 10:11

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aaaaaaaa1111

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4#
 楼主| 发表于 2023-12-21 10:09 | 只看该作者
狂羁青马 发表于 2023-12-21 10:009 l& d, o1 E8 G$ L0 Q1 B
可以分享一下你的K7模型吗，邮箱
; }( {1 w6 z- V
不知道是不是我的模型不对导致这个地方报错

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aaaaaaaa1111

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5#
 楼主| 发表于 2023-12-21 10:11 | 只看该作者
狂羁青马 发表于 2023-12-21 10:01
9 f0 x, H6 @& m4 x- H感觉是net没匹配起来
/ U4 w6 N9 z. r, u# T) a4 r9 g, y: N( P
是我选择的net吗？我为了验证只选择了三条net
; S. u% W5 M% ^: W! W, W

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硬件老兵

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6#
发表于 2024-4-9 16:32 | 只看该作者
哈哈哈哈，Mark一下

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