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logic原理图传送网表到layout里面报错这个怎么解决哦

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1#
发表于 2012-5-22 23:54 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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logic原理图传送网表到layout里面报错这个
5 w, s: M5 P! r/ DPart Type CON-1 has the following gate pins that do not match to the Library part:9 X6 x+ l4 v, L- E; o
(16 14) (13 16) (20 17) (17 18) (18 19) (19 12) (23 13) (12 7) (14 24) (24 4)
5 M- i4 J5 {) k# E( |0 a(7 5) (4 20) (5 23) (9 2) (10 21) (2 15) (21 22) (22 11) (11 10) (8 9)
  }8 j) c! Z7 I( T" J2 j(3 8) (1 3) (15 1).8 k, }# [# f% U
Non matching Part Type CON-1 is used by the following parts:
% m/ I9 m5 E7 `2 R5 k2 z2 @% kU40.
3 g* v/ T2 ~1 @8 S0 C0 {) A  v. G$ z, [1 i
这个报错是什么意思哦, Y  u$ {+ I2 }. I; Q* U2 K7 S5 E
出现这种问题如何解决?
/ I7 @5 Z- G( v! i9 s! n/ J0 `' M5 }8 o0 X% @  o
高手帮下,谢谢!!!
4 {# C; C1 C! j  l2 G

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2#
 楼主| 发表于 2012-5-24 22:42 | 只看该作者

RE: logic原理图传送网表到layout里面报错这个怎么解决哦

谁告诉我一下哦

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3#
发表于 2012-5-25 09:13 | 只看该作者
检查下U40的封装库、

评分

参与人数 1贡献 +5 收起 理由
jimmy + 5 很给力!

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4#
发表于 2012-5-25 11:49 | 只看该作者
U40的封装:原理图管脚排列与PCB对应不上。
8 z+ O0 f+ _! ~% }- t0 e- k) a7 y( D7 i. |7 F, O5 H1 t4 f
是库的问题。

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5#
 楼主| 发表于 2012-5-25 21:33 | 只看该作者

RE: logic原理图传送网表到layout里面报错这个怎么解决哦

jimmy 发表于 2012-5-25 11:49 8 ~2 M5 J0 ^& ~  Q1 I
U40的封装:原理图管脚排列与PCB对应不上。
$ b6 N, x) t1 ]3 W  j
$ I" D, {0 B( C3 l$ H是库的问题。

- \0 i6 G% j* |2 [5 B- Y额,谢谢Jimmy
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