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一般做封装时要做Assembly_top吗?

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1#
发表于 2013-3-19 10:59 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
: A+ c/ R9 |% j0 O# I2 b2 ]  P6 w
如上图,一般你们做封装时会做Assembly_top吗?
2 O+ Z' }1 J& V! n4 m, ~& V8 R9 B还是只做以下两个就OK了?
7 @6 C8 V' [$ e) A ) M* ~) `6 G5 \: ~# y* W) a3 s" B

点评

建议做上去!  发表于 2013-3-19 11:03
  • TA的每日心情

    2021-8-2 15:01
  • 签到天数: 37 天

    [LV.5]常住居民I

    2#
    发表于 2013-3-19 11:39 | 只看该作者
    Assembly_top是实体大小
    3 u3 A# n/ u' P6 ^9 M9 a可用来给机构确认或是标示极性脚位用
    4 A, t4 C0 {0 F0 V我目前遇见的此层是必要的

    该用户从未签到

    3#
     楼主| 发表于 2013-3-19 11:58 | 只看该作者
    必要?

    该用户从未签到

    4#
     楼主| 发表于 2013-3-19 12:27 | 只看该作者
    Assembly_top这个出gerber时貌似用不上啊,还是只是设计时方便做一些标示?

    该用户从未签到

    5#
    发表于 2013-3-19 12:32 | 只看该作者
    看公司大小,如果是大公司,有流程,这层必须保留,如果是小公司,有无均可

    该用户从未签到

    6#
     楼主| 发表于 2013-3-19 13:15 | 只看该作者
    inspiron1501 发表于 2013-3-19 12:32 7 }* K# b7 V8 N9 |
    看公司大小,如果是大公司,有流程,这层必须保留,如果是小公司,有无均可
    / Q0 x; u3 E1 T- j! h
    那按正规流程走,这层应该画什么东西?

    该用户从未签到

    7#
    发表于 2013-3-19 13:19 | 只看该作者
    本帖最后由 幸福万岁 于 2013-3-19 13:27 编辑
    " Q7 l8 F8 G9 q9 w1 \4 d
    - f  j- e2 f2 U装配层    比如有些需要外接器件可以多画个place_bound_top* {7 R, A- A$ J# A: [6 j* k# l
    貌似一样
    & G' N9 @* E2 W9 ?& h: v1 L这一层 我从来不画

    该用户从未签到

    8#
    发表于 2013-3-19 14:29 | 只看该作者
    我一般画原件实际外框

    该用户从未签到

    9#
     楼主| 发表于 2013-3-19 14:54 | 只看该作者
    我认为必须画的两个.1,place-bound-top
    ) W/ z* i6 i8 C% E- ]& ]8 m                            2,silkscreen-top
    2 X* |, A  K& W这两个画了就OK了,有不同见解的吗?

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    10#
    发表于 2013-3-19 22:14 | 只看该作者
    没有必要,但是画上去的话,可以用assembly层出装配文件给装配人员,毕竟有一些板子器件密度太高,用丝印层很难看清楚。

    该用户从未签到

    11#
    发表于 2013-3-20 14:18 | 只看该作者
    有总比不没有好,等你需要用到这层的时侯,再修改就麻烦了。
    + q+ s) h/ l- \" U- k% W1 T) j
    ! \! ^2 e5 R5 B% D所以尽量都加上,一般是器件形状,方向和其它一些注脚.
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