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MIPI trace上的bypass电容是否有要求?

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1#
发表于 2023-1-29 10:13 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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MIPI trace上的bypass电容是否有要求?
0 z+ v; w4 C$ k9 u* o; U$ E) N

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2#
发表于 2023-1-29 10:54 | 只看该作者
MIPI trace上的bypass cap最多47 pF。。。

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3#
发表于 2023-1-29 13:18 | 只看该作者
去耦电容和旁路电容都是起到抗干扰的作用,电容所处的位置不同,称呼就不一样了

该用户从未签到

4#
发表于 2023-2-8 18:10 | 只看该作者
这多半跟芯片厂商讨论   各家芯片要求不一8 P; B$ i' H, Y' _8 J, `
除了MIPI   许多控制讯号   像是PCIe
/ ?# R) U# [9 T0 \6 e其落地电容值都有规范3 c& M. ~/ I' j' ~/ R; L4 O. U
因为值太大   会使上升/下降时间拉长
( D9 B8 {: I9 G: q8 T, R  ]进而影响逻辑判断   导致控制出问题
& H+ X: Q: q0 n7 A- a1 G6 k! [$ D2 T& Q: ~0 u
所以有些厂商  对于走线长度也有规范   即便走内层
4 `- C8 g! l( L! c(走表层会有EMI辐射问题  肯定太长不允许)
! d$ e5 Q+ K- C5 H$ @+ ~原因在于走线太长   除了Loss大   整体寄生电容也大2 M8 R: B* h6 |( p5 \8 f* P  O
- b$ X8 Q- n% I4 t# q3 X5 ^: X' G
当然你说寄生电容这么关键的话   要不要联机宽都限制?
( y2 E/ K+ [1 F" |; T基本上是没严苛到这样  
6 G* l0 J/ z! u* b况且有些控制讯号   像是PCIe   需要阻抗控制  90 Ohm
" A% I9 D' ~; z那线宽就不能乱调
' F' s+ v% Q5 H0 O
& I  }8 L: \2 X3 |+ p6 S8 C$ x( G, f1 k: ]
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