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请教SDRAM等长布线?

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1#
发表于 2009-4-28 22:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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现在布线布到SDRAM了
. F: p% ~! Y8 D  Q想请教下:
( |- z2 j1 j  {' s1:数据线、地址线、控制线 哪一组对等长要求比较严格呀?
0 ^2 m% D/ `  q% Z# r2:数据线、地址线、控制线、时钟线 布线的长短关系式怎么样的呀?
, b: h9 |9 l7 N5 J, G" B3:DSP到两个SDRAM的数据线 地址线 控制线是在各个SDRAM处等长呀还是两个SDRAM处都要求等长呀?6 n& u9 r. \# I* C1 v
    比如D0、D1到SDRAM1,D2、D3到SDRAM2,这样的话是D0、D1相等呀还是要求D0、D1、D2、D3都必须要相等呀?3 H& I1 c5 _! R; m
    那么地址线 时钟线 控制线也和数据线的要求一样吗?
' V; }2 m9 u' j( t8 R4:在走线中间加的匹配电阻应该记入等长线里面吗?该如何计算?+ K9 e4 b) B' i& Z( @  S! w' G, F9 D
5:等长线是引脚到引脚间的长度吗?

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2#
 楼主| 发表于 2009-4-28 22:47 | 只看该作者
关于这点有太多的疑问了, j: }. ?/ I3 B" f+ A+ Z& w; R% i
希望大家多多指点
6 ?8 f2 q- ?0 h谢谢
) q- \/ b: z9 _' ~( G7 W; F+ w: A讲的越详细越好5 f/ i6 G& t& N+ ]
谢谢

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3#
发表于 2009-4-29 09:14 | 只看该作者
有太多的疑问,感觉你没有理解芯片的工作方式,建议你还是先学习一下芯片的时序图,要不等你调试的时候也很郁闷。

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4#
 楼主| 发表于 2009-4-29 09:39 | 只看该作者
有太多的疑问,感觉你没有理解芯片的工作方式,建议你还是先学习一下芯片的时序图,要不等你调试的时候也很郁闷。' L* L2 ?" q3 U6 _1 c! x
liqiangln 发表于 2009-4-29 09:14
, F, u4 I7 ~; A( J; A# \& t
谢谢4 a  f! M+ ]2 b
能不能说的详细点呢
头像被屏蔽

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5#
发表于 2009-4-29 14:52 | 只看该作者
提示: 作者被禁止或删除 内容自动屏蔽

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6#
 楼主| 发表于 2009-4-29 15:10 | 只看该作者
SDRAM不需要考虑等长问题,除非你的走线特别长(>4000mil)。别把问题复杂化。而且千万不要认为涉及到高速数字信号就是等长问题!
! A3 u. E2 E9 L; b% R_hhh_ 发表于 2009-4-29 14:52
8 m! `1 @9 H4 [
所有的走线都不考虑等长吗?
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