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[Cadence Sigrity] Sigrity DDR仿真时眼图查看

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发表于 2018-8-7 18:30 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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Sigrity DDR仿真时眼图查看时可以一个位宽(产品CPU为16位)一块查看吗?时序和抖动余量;
3 }7 |$ X9 H# K- S之前看一老师仿真视频,多组数据一块打开时,眼图很差,他是单独每根数据独立查看;) c; d; X3 U5 x5 D7 N+ I
此处有疑问;请高手帮忙解答;
! t0 l' @. j4 d2 s) p9 r! f: q多谢;# w9 e" ^6 a- ]0 @  H* c- z( q

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2#
发表于 2019-2-25 09:52 | 只看该作者
需要一起看

点评

一块看时,芯片器件的封装长度该如何提取到PCB对应的S参数中;  详情 回复 发表于 2019-4-11 11:42

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3#
 楼主| 发表于 2019-4-11 11:42 | 只看该作者
Lee_G10D0 发表于 2019-2-25 09:52
. W" v( r3 K, I+ c# P% X& A需要一起看
8 t0 g! e! _  C+ j; E, m
一块看时,芯片器件的封装长度该如何提取到PCB对应的S参数中;

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5#
发表于 2023-4-4 11:00 | 只看该作者
需要一起看
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