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[仿真讨论] [求助] sigrity中的 trace 和 shape

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1#
发表于 2015-12-24 13:40 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
各位,* t" l+ _: T+ ?8 B& U. j& m0 M7 N" |

; P) x/ }1 b1 S9 d. W   (1)sigrity软件是对待trace和shape的 (分别是怎么建模的)?, X0 R4 }# l* E- N- T2 B& Y
   (2)在DC drop中,trace和shape是同等效果的吗?
6 a/ W+ d$ {- [$ |( J  N9 T  m6 c# l% J: @

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2#
发表于 2015-12-24 14:07 | 只看该作者
我所了解的信息,供参考:
* S  Q. P$ q( o% t1.sigrity导入pcb设计文件会区分trace和shape,这个是传输线类型的建模。算法上,trace采用BEM+FEM,shape采用BEM,过孔采用局部FEM,所以高频下trace的准确度要高于shape,低频下shape的准确度要高于trace。但不管什么算法,碰到不连续的传输线结构,这种2.5D的软件在精确度上都会有所欠缺。+ @( V# T1 q# _2 {
2.DC drop是静态的分析,trace和shape等效。
, `# x" v5 [8 o' }& ?

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3#
 楼主| 发表于 2015-12-28 14:25 | 只看该作者
本帖最后由 l888888h 于 2015-12-28 14:35 编辑
, d8 \+ Y0 }1 M, ]
% x+ i2 h7 H3 |# B谢谢
7 H  g8 ]2 k1 L8 h7 D4 D
, K. o7 \- Q' \' t7 A  遇到了一个问题,一个小power(用trace连接的)在做DC drop的时候,用半成品的PCB文件(只处理了电源部分,其它部分是空的)时,仿真出
- X, v4 o' H# W* o: k& ]的结果是错的(得出的阻抗太小了,明显是错的),将trace转换为shape后,得出的就结果正常了
4 p: a8 u' W; @* M  等整个PCB全部完成后(电源部分,信号线部分都完成了),再次仿真,结果又正常了(依然是用trace连接的)
8 e3 K; x! ]* C4 o  N, W% D, `; f. E/ f

点评

你这种神奇的问题我也遇到过,没找出原因  详情 回复 发表于 2015-12-28 14:50

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4#
发表于 2015-12-28 14:50 | 只看该作者
l888888h 发表于 2015-12-28 14:257 ^/ R5 a2 N6 ]+ Q) K
谢谢# O5 Y5 _* H2 v- L
4 V( o' E6 i" \# V8 m1 R2 X3 f
  遇到了一个问题,一个小power(用trace连接的)在做DC drop的时候,用半成品的PCB文件(只处理了 ...

; o0 b9 g4 u/ N4 \, M2 b  ]9 s9 C# D你这种神奇的问题我也遇到过,没找出原因
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