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请问SDRAM时钟线的宽度比数据地址线宽会不会引起阻抗不匹配?谢谢

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1#
发表于 2008-9-24 00:57 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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看到一些设计中的sdram的时钟线比数据和地址线宽,数据地址线控制在50欧姆,
1 K/ s4 }" H! S- }, c; t7 R  y" ]8 H那么时钟线的阻抗就会小于50欧姆,这样对时钟线的信号质量的影响到底是好还是坏呢?% i  D8 B# e. H# x4 |8 N- ?- y

9 ?) z) J  u8 P6 c, T谢谢。

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2#
发表于 2008-9-24 08:37 | 只看该作者
阻抗匹配是对于单个网络来说的。
. F  m2 [( Y* M9 n可以参考下特征阻抗的公式,阻抗不仅与线宽相关。% D; {  l1 D0 e0 w6 l3 y  K; s* b* V
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如果从趋肤效应来讲,时钟的线宽比较大有利于降低损耗。

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3#
 楼主| 发表于 2008-9-24 11:00 | 只看该作者
原帖由 forevercgh 于 2008-9-24 08:37 发表
% J2 F+ u. p* @$ W' |0 T% y. i阻抗匹配是对于单个网络来说的。# K2 o5 x- i! V, |
可以参考下特征阻抗的公式,阻抗不仅与线宽相关。
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. k4 B9 F; y! [6 O( T' q6 a  f3 R如果从趋肤效应来讲,时钟的线宽比较大有利于降低损耗。

% G% X% {9 R- l, U* B. Y. M% Z! D+ r- M7 K2 w: g; R
我的意思是说,数据地址线上50欧姆阻抗是和芯片输入输出阻抗匹配的
% {. R6 `- u- h' y0 ]+ F5 o时钟线线宽变宽,阻抗降低,是不是会引起时钟线和芯片的输入输出阻抗不匹配。" T: V1 z3 a2 a8 C
8 J* {" T3 x+ m6 M5 Q
这个意思很难理解吗?

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4#
发表于 2008-9-25 09:03 | 只看该作者
时钟buffer和数据线buffer是不同的。

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5#
发表于 2008-9-25 09:26 | 只看该作者

如果可以,数据也可以低于50ohm,时钟阻抗低了更好

原帖由 matice 于 2008-9-24 11:00 发表
0 V6 \. }5 c% L0 J, `# D9 p
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我的意思是说,数据地址线上50欧姆阻抗是和芯片输入输出阻抗匹配的  {5 F6 E* k3 P' @1 {4 a
时钟线线宽变宽,阻抗降低,是不是会引起时钟线和芯片的输入输出阻抗不匹配。
! _$ q, v# U% f( G" k* D$ y* S7 W5 o/ y2 Q
这个意思很难理解吗?
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阻抗是个范围,可能是封闭区间,也可能是个半闭区间,跟其余因素也有关系。; Z1 e' F3 R& ]* P, |  L& S

! C1 I9 [* N' O" q# ]7 O7 I你说的这种情况没有关系,是对的,你就这样做吧。

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6#
发表于 2008-9-26 12:44 | 只看该作者
传输线阻抗是在频率下的一个范围,时钟通常100M,数据基本就是200M,所以你的物理约束在50欧姆,但是在不同频率下测出来的阻抗是不同的;既然你加宽了时钟线的宽度,其实在反射上问题不大,但是在工程制作上感觉你是不是增加了成本了呢?
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