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[Cadence Sigrity] SigXplorer中Rel Prop Delay问题

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发表于 2015-3-27 15:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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allegro中,CPU到DDR的线,设置了XNET和T点,走线完成后,在显示等长数值的地方看 没有数值,黄色。3 @  s5 X8 w. Z5 U
有几根线的在SigXplorer中看,没有设置模板,要这么解决,坐等回复& Y: D6 b7 J& a' r

1 ]' ?& ~. B) D7 y点Cmgr图标等长处显示: 9 ?# w0 O# O+ I& h. `. g

( T! }0 d9 C. ^9 }- V在SigXplorer查看,正确的地方为:
: H! J1 h  q1 T  B; N: w- J( `* h 1 C7 k6 r  B9 J  B5 o

6 m( Y2 t/ M2 |1 F异常的网络为:
- ]! M* k( Z2 O0 f3 Y! h2 C3 H: h" i
0 w' e( X: d9 u1 K6 L2 }
0 b: O; v$ k  |, `4 i8 Y* S

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2#
 楼主| 发表于 2015-3-27 15:31 | 只看该作者
就是同一组等长,设置模板没有到其中的2个网络。要怎么解决

该用户从未签到

3#
 楼主| 发表于 2015-3-30 16:54 | 只看该作者
最后用最原始的方法,删除T点和XNET再重新设置了
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