|
|
EDA365欢迎您登录!
您需要 登录 才可以下载或查看,没有帐号?注册
x
在完成MOS管芯片在制作之后,需要给MOS管芯片加上一个外壳,这就是MOS管封装。该封装外壳主要起着支撑、保护和冷却的作用,同时还可为芯片提供电气连接和隔离,从而将MOS管器件与其它元件构成完整的电路。
3 O. Y7 h) J2 ?& _* v+ q, m: W8 K
而不同的封装、不同的设计,MOS管的规格尺寸、各类电性参数等都会不一样,而它们在电路中所能起到的作用也会不一样;另外,封装还是电路设计中MOS管选择的重要参考。封装的重要性不言而喻,今天我们就来聊聊MOS管封装的那些事。( h4 e( k1 P \8 d F7 L# z3 o8 f
* L5 M( A5 I1 k' z9 ]* m% w6 u
d$ a* |2 j) Z' fMOS管封装分类
7 t5 r5 J5 S: U
$ |% G. ^0 T5 c, l/ l6 P. k按照安装在PCB板上的方式来划分,MOS管封装主要有两大类:插入式(Through Hole)和表面贴装式(SuRFace Mount)。
( U/ k0 a" h& X; X9 Z$ W* F$ ~3 e+ g
! d* ^+ U, x; P- O插入式就是MOSFET的管脚穿过PCB板的安装孔并焊接在PCB板上。常见的插入式封装有:双列直插式封装(DIP)、晶体管外形封装(TO)、插针网格阵列封装(PGA)三种样式。0 u% @6 i( k4 p
& f( B5 u! j; c. W6 g: N
插入式封装
% I0 z# c1 U0 K# B8 E" B, ^% \1 a! h9 n0 X9 T/ [* Z
表面贴裝则是MOSFET的管脚及散热法兰焊接在PCB板表面的焊盘上。典型表面贴装式封装有:晶体管外形(D-PAK)、小外形晶体管(SOT)、小外形封装(SOP)、方形扁平式封装(QFP)、塑封有引线芯片载体(PLCC)等。; c$ O+ G& V4 f
M3 }! n& V0 ?表面贴装式封装0 W1 s1 j' {0 a) Q* L
) T. s2 y" M+ V. S2 r% j' D
随着技术的发展,目前主板、显卡等的PCB板采用直插式封装方式的越来越少,更多地选用了表面贴装式封装方式。/ l6 S5 G$ {$ t% `# o2 w( u
9 C4 m* t( O# E( a8 |9 @5 C( \; c1、双列直插式封装(DIP)/ q2 ^, ?; p0 l% D
5 c4 }$ E3 Z9 \1 Z% a& h
DIP封装有两排引脚,需要插入到具有DIP结构的芯片插座上,其派生方式为SDIP(Shrink DIP),即紧缩双入线封装,较DIP的针脚密度高6倍。
D; n0 p$ `5 h& x! W5 m; B, Z) q9 \* L
DIP封装结构形式有:多层陶瓷双列直插式DIP、单层陶瓷双列直插式DIP、引线框架式DIP(含玻璃陶瓷封接式、塑料包封结构式、陶瓷低熔玻璃封装式)等。DIP封装的特点是可以很方便地实现PCB板的穿孔焊接,和主板有很好的兼容性。
. V: N0 G& F [$ C
8 E4 U+ {0 T9 b但由于其封装面积和厚度都比较大,而且引脚在插拔过程中很容易被损坏,可靠性较差;同时由于受工艺的影响,引脚一般都不超过100个,因此在电子产业高度集成化过程中,DIP封装逐渐退出了历史舞台。
1 V! r( [( ?, }) w4 L0 u t$ Q
' K, U5 D0 q$ v; z7 q l) p2、晶体管外形封装(TO)
' p3 f; ~8 `" K6 p$ K! D* O6 D. ~6 O) Z
属于早期的封装规格,例如TO-3P、TO-247、TO-92、TO-92L、TO-220、TO-220F、TO-251等都是插入式封装设计。' J# D% S1 n& V9 o2 t3 M7 @
. z4 A, U, X+ Q# \TO-3P/247:是中高压、大电流MOS管常用的封装形式,产品具有耐压高、抗击穿能力强等特点。
) V; v+ }' x o8 r6 O& H
) L t. ^9 T' x6 Q+ z! U; C8 mTO-220/220F:TO-220F是全塑封装,装到散热器上时不必加绝缘垫;TO-220带金属片与中间脚相连,装散热器时要加绝缘垫。这两种封装样式的MOS管外观差不多,可以互换使用。
0 F9 a/ ~2 x' @" S, O, t" v. ^3 ?. g, t; ]$ w+ Z1 S
TO-251:该封装产品主要是为了降低成本和缩小产品体积,主要应用于中压大电流60A以下、高压7N以下环境中。
N8 t& x/ ~' ?' k+ x
1 v: Z6 E8 a7 oTO-92:该封装只有低压MOS管(电流10A以下、耐压值60V以下)和高压1N60/65在采用,目的是降低成本。! a d& f7 P) I N/ X
2 @7 p: c. c' W5 v
近年来,由于插入式封装工艺焊接成本高、散热性能也不如贴片式产品,使得表面贴装市场需求量不断增大,也使得TO封装发展到表面贴装式封装。TO-252(又称之为D-PAK)和TO-263(D2PAK)就是表面贴装封装。: W. E* T) x( t9 x7 z
1 @# A9 `8 w: y+ V6 {TO封装产品外观! R$ u' K* L6 x# t6 m% u, @8 I
/ r# D3 [4 q8 t/ u! k# b
TO252/D-PAK是一种塑封贴片封装,常用于功率晶体管、稳压芯片的封装,是目前主流封装之一。
1 N) s7 T, h& h. {% G/ ~
6 w) J5 {6 N# [, }采用该封装方式的MOSFET有3个电极,栅极(G)、漏极(D)、源极(S)。
; j0 ~+ S% ~; L s* S- j4 O+ V2 e6 u7 k% o
其中漏极(D)的引脚被剪断不用,而是使用背面的散热板作漏极(D),直接焊接在PCB上,一方面用于输出大电流,一方面通过PCB散热;所以PCB的D-PAK焊盘有三处,漏极(D)焊盘较大。其封装规范如下:
5 A+ e- t1 u4 ?1 e# X# d e: K0 k; S8 y$ B3 {) o e- j6 X1 u
; H7 p2 S9 \ e: C/ S
! C; v3 S, y+ ?; Z6 o$ R3 I8 u7 UTO-252/D-PAK封装尺寸规格6 e( c* S6 \& `1 w( Z9 ~- Q) ]
! P9 q$ |. _& R* b
TO-263是TO-220的一个变种,主要是为了提高生产效率和散热而设计,支持极高的电流和电压,在150A以下、30V以上的中压大电流MOS管中较为多见。
% z8 ~% z+ V) D4 k
7 n ^, D4 b5 ]% y" ~4 @$ Y. L除了D2PAK(TO-263AB)之外,还包括TO263-2、TO263-3、TO263-5、TO263-7等样式,与TO-263为从属关系,主要是引出脚数量和距离不同。! C; d$ M1 N# Z+ T% X
( N5 I- o0 S4 h1 w! U- p2 J3 L+ ^7 I" X# [3 b4 f6 U
3 ?/ Y+ c8 m3 G: Z
TO-263/D2PAK封装尺寸规格
8 j: c% {$ c; {& @5 A/ W3 [1 j+ [+ [% [' e1 n0 j6 S( l6 D. L& k
3、插针网格阵列封装(PGA) m5 T3 Y3 n* {' W7 d: w+ y
- L! f3 |& \! `! u4 E
PGA(Pin Grid Array Package)芯片内外有多个方阵形的插针,每个方阵形插针沿芯片的四周间隔一定距离排列,根据管脚数目的多少,可以围成2~5圈。安装时,将芯片插入专门的PGA插座即可,具有插拔方便且可靠性高的优势,能适应更高的频率。& F0 _5 S8 |+ M
2 L7 G) @9 s6 v8 T9 c! i! Z- {PGA封装样式
. Y3 N7 W1 f+ q: u; t5 }# j8 O9 o( s: J# a. v6 g& s* N
其芯片基板多数为陶瓷材质,也有部分采用特制的塑料树脂来做基板,在工艺上,引脚中心距通常为2.54mm,引脚数从64到447不等。/ H7 V0 M0 c$ x5 G
2 c) E& L+ [. \4 l# s5 s
这种封装的特点是,封装面积(体积)越小,能够承受的功耗(性能)就越低,反之则越高。这种封装形式芯片在早期比较多见,且多用于CPU等大功耗产品的封装,如英特尔的80486、Pentium均采用此封装样式;不大为MOS管厂家所采纳。2 _* R5 {) K' \
% Z. }( X$ s# `. l: e( S
4、小外形晶体管封装(SOT), e6 |0 t) B; O7 e* ?+ _' {* g
6 C. b( q5 Y' t* |! Y9 @
SOT(Small Out-Line Transistor)是贴片型小功率晶体管封装,主要有SOT23、SOT89、SOT143、SOT25(即SOT23-5)等,又衍生出SOT323、SOT363/SOT26(即SOT23-6)等类型,体积比TO封装小。+ N% y; e5 ^4 b3 E; e; @. c
! r3 [9 U, L u* ?$ I6 gSOT封装类型
1 |; q0 b4 d9 A2 W- o% W0 U
' E" S+ l3 s/ {1 N) j5 VSOT23是常用的三极管封装形式,有3条翼形引脚,分别为集电极、发射极和基极,分别列于元件长边两侧,其中,发射极和基极在同一侧,常见于小功率晶体管、场效应管和带电阻网络的复合晶体管,强度好,但可焊性差,外形如下图(a)所示。% Z- A% k2 V7 ^! D: m5 J) @/ m i
# T T: ^2 |" m7 i9 u. z4 L
SOT89具有3条短引脚,分布在晶体管的一侧,另外一侧为金属散热片,与基极相连,以增加散热能力,常见于硅功率表面组装晶体管,适用于较高功率的场合,外形如下图(b)所示。% W# U, \3 x& U0 a
4 q2 ~$ k, Q4 s7 Z: x5 g9 y" D) OSOT143具有4条翼形短引脚,从两侧引出,引脚中宽度偏大的一端为集电极,这类封装常见于高频晶体管,外形如下图(c)所示。' A& ^* A( Q! x# p# C/ R, C' D* {" A
- m% I, z2 p$ H* B# ^; R# dSOT252属于大功率晶体管,3条引脚从一侧引出,中间一条引脚较短,为集电极,与另一端较大的引脚相连,该引脚为散热作用的铜片,外形如下图(d)所示。
! M5 [- N9 i' N7 @; F/ X
& T7 |- D* z& ]$ A! u常见SOT封装外形比较: u# D7 X. e7 J: Z
7 h6 j: X1 f2 k1 Z) D主板上常用四端引脚的SOT-89 MOSFET。其规格尺寸如下:; M' A7 c. G& G9 ]# i1 o3 [
6 M' {) T1 r! s1 B0 a1 M# |, [
6 V' K! Y8 x. G( v1 y2 a9 L
( y7 H2 |1 F: w- g
SOT-89 MOSFET尺寸规格(单位:mm), m: g+ Y7 ~# S( L" a( b
* u6 Z" X$ w8 Q& D1 w) t" {/ [5、小外形封装(SOP)& i1 x3 k# u- S" T0 K9 N% E
$ ~* {) O* s8 H3 f0 {7 g) d
SOP(Small Out-Line Package)是表面贴装型封装之一,也称之为SOL或DFP,引脚从封装两侧引出呈海鸥翼状(L字形)。材料有塑料和陶瓷两种。0 N8 W% {7 v& v+ ^' H
$ h- J7 |7 F# g, k( q
SOP封装标准有SOP-8、SOP-16、SOP-20、SOP-28等,SOP后面的数字表示引脚数。MOSFET的SOP封装多数采用SOP-8规格,业界往往把“P”省略,简写为SO(Small Out-Line)。
q+ u6 f/ W5 t2 r; h
; z$ f: Z5 w% z) v# Z `8 r: {1 ASOP-8封装尺寸
" F5 a( |; F) o( R8 y6 C2 T. M2 c( V1 T# s0 L) R' Q
SO-8为PHILIP公司率先开发,采用塑料封装,没有散热底板,散热不良,一般用于小功率MOSFET。. N% {( X* z. l
0 `; E: x. ~! {# s/ S3 d, m2 ?6 a后逐渐派生出TSOP(薄小外形封装)、VSOP(甚小外形封装)、SSOP(缩小型SOP)、TSSOP(薄的缩小型SOP)等标准规格;其中TSOP和TSSOP常用于MOSFET封装。2 W; x& w; [% ?) O0 X
/ h; A8 [6 {( x3 o$ j3 r
" Y$ ~8 j( b2 V( Z3 i2 s1 M% }7 c$ C/ l, ], T
常用于MOS管的SOP派生规格
: ]- @8 P) T! {1 @' c
* K, b$ s- G2 j8 a6、方形扁平式封装(QFP)
1 H/ M! v+ R9 a7 \# ]5 J( f
3 T( O6 ~2 |! Y* a" C! p4 k( ZQFP(Plastic Quad Flat Package)封装的芯片引脚之间距离很小,管脚很细,一般在大规模或超大型集成电路中采用,其引脚数一般在100个以上。
# Q9 s# E7 X: a4 s6 G( z/ E- a# O; A, a+ K
用这种形式封装的芯片必须采用SMT表面安装技术将芯片与主板焊接起来。该封装方式具有四大特点:0 b$ E- r ]! b" |& `( z
3 T; B% n2 l! }$ [% J* [" k: X
①适用于SMD表面安装技术在PCB电路板上安装布线;6 X1 B3 c+ X% J& @2 i
: F+ y. h2 b2 }5 N+ g# K
②适合高频使用;4 n0 N" ^& q, ] w; \- J
1 H/ k ^* a( q1 d③操作方便,可靠性高;
# E F$ a0 u6 s' g
6 R2 A3 i2 A8 j/ h \④芯片面积与封装面积之间的比值较小。$ q. r0 T1 d8 D2 J9 e/ E, |
& L% y1 I2 M8 f' p与PGA封装方式一样,该封装方式将芯片包裹在塑封体内,无法将芯片工作时产生的热量及时导出,制约了MOSFET性能的提升;而且塑封本身增加了器件尺寸,不符合半导体向轻、薄、短、小方向发展的要求;另外,此类封装方式是基于单颗芯片进行,存在生产效率低、封装成本高的问题。3 T' p# K+ t6 }/ k" W& u+ t* b: @$ I1 s
; m. e2 y% e' H
因此,QFP更适于微处理器/门陈列等数字逻辑LSI电路采用,也适于VTR信号处理、音响信号处理等模拟LSI电路产品封装。2 d4 a/ r; }" [' w' n
" `. V- C J, g
7、四边无引线扁平封装(QFN)
$ I+ B3 W& z+ O: Z; {- e& e+ [: ^' x8 F$ _; S
QFN(Quad Flat Non-leaded package)封装四边配置有电极接点,由于无引线,贴装表现出面积比QFP小、高度比QFP低的特点;其中陶瓷QFN也称为LCC(Leadless Chip Carriers),采用玻璃环氧树脂印刷基板基材的低成本塑料QFN则称为塑料LCC、PCLC、P-LCC等。
# l4 k# J% h$ F7 M7 o$ B6 N U0 Y" M) P8 N, v% h
是一种焊盘尺寸小、体积小、以塑料作为密封材料的新兴表面贴装芯片封装技术。7 w; Q* y }- n$ _- C
( V9 p$ K+ C5 ~# e2 R! y1 M8 qQFN主要用于集成电路封装,MOSFET不会采用。不过因Intel提出整合驱动与MOSFET方案,而推出了采用QFN-56封装(“56”指芯片背面有56个连接Pin)的DrMOS。
& S; X2 b) {) ~" X
0 x5 U9 u) [7 n9 f8 s需要说明的是,QFN封装与超薄小外形封装(TSSOP)具有相同的外引线配置,而其尺寸却比TSSOP的小62%。根据QFN建模数据,其热性能比TSSOP封装提高了55%,电性能(电感和电容)比TSSOP封装分别提高了60%和30%。最大的缺点则是返修难度高。5 T1 M. [% V* y/ g( a* ?% f9 I, ^
# B8 G6 c3 Q0 e" F采用QFN-56封装的DrMOS
! a& n9 }" v& t- y0 u5 k6 Z7 }: B$ _2 p
随着技术的革新与进步,把驱动器和MOSFET整合在一起,构建多芯片模块已经成为了现实,这种整合方式同时可以节省相当可观的空间从而提升功耗密度,通过对驱动器和MOS管的优化提高电能效率和优质DC电流,这就是整合驱动IC的DrMOS。! W, W. a. G8 c# y1 K# g
& j( ^$ u2 O! Y7 Z1 M瑞萨第2代DrMOS
% d* D- h; ~% h" L' V5 H' q, @3 U1 P# x# C
经过QFN-56无脚封装,让DrMOS热阻抗很低;借助内部引线键合以及铜夹带设计,可最大程度减少外部PCB布线,从而降低电感和电阻。
E' Z7 x3 ?! |. t( O4 p" g% l
& k* B6 L+ v5 I% }9 P另外,采用的深沟道硅(trench silicon)MOSFET工艺,还能显著降低传导、开关和栅极电荷损耗;并能兼容多种控制器,可实现不同的工作模式,支持主动相变换模式APS(Auto Phase Switching)。
6 `0 p+ z. D& p0 N- _5 S& E! l1 p8 m) I! t( H- c% ~& s
除了QFN封装外,双边扁平无引脚封装(DFN)也是一种新的电子封装工艺,在安森美的各种元器件中得到了广泛采用,与QFN相比,DFN少了两边的引出电极。
1 N6 T' F1 M+ v8 N& w; ]
* e" ?; [$ z& W8、塑封有引线芯片载体(PLCC)
& `& ]* x/ C$ I
" g( |. s N! QPLCC(Plastic Quad Flat Package)外形呈正方形,尺寸比DIP封装小得多,有32个引脚,四周都有管脚,引脚从封装的四个侧面引出,呈丁字形,是塑料制品。3 x, C, {; m: B! y
7 A- \: S8 w% C. b) G* _) b
其引脚中心距1.27mm,引脚数从18到84不等,J形引脚不易变形,比QFP容易操作,但焊接后的外观检查较为困难。PLCC封装适合用SMT表面安装技术在PCB上安装布线,具有外形尺寸小、可靠性高的优点。% N' s: N5 D* T
1 m. m* m8 }# `+ D; yPLCC封装是比较常见,用于逻辑LSI、DLD(或程逻辑器件)等电路,主板BIOS常采用的这种封装形式,不过目前在MOS管中较少见。
) Y. r- f A& o- c: z4 g' o: I" v2 G3 R
PLCC封装样式0 z; }% d; f5 D3 Z8 j% Q: {
, x9 [- ]6 i, J6 Q K. K6 D主流企业的封装与改进
8 K t0 ]) Y0 S& {7 s9 X- l- e$ Y" q- W: m7 v) B% \6 r
由于CPU的低电压、大电流的发展趋势,对MOSFET提出输出电流大,导通电阻低,发热量低散热快,体积小的要求。MOSFET厂商除了改进芯片生产技术和工艺外,也不断改进封装技术,在与标准外形规格兼容的基础上,提出新的封装外形,并为自己研发的新封装注册商标名称。" u5 P' z7 N! D2 y' A
1 a# J; u5 Y2 h0 I2 U( _1 |% \1、瑞萨(RENESAS)WPAK、LFPAK和LFPAK-I封装
0 Z" m! G/ r4 a# m% `
& ` ?) T# E+ ~* o: FWPAK是瑞萨开发的一种高热辐射封装,通过仿D-PAK封装那样把芯片散热板焊接在主板上,通过主板散热,使小形封装的WPAK也可以达到D-PAK的输出电流。WPAK-D2封装了高/低2颗MOSFET,减小布线电感。: U# b# u% p* Q: j8 m9 U: _
+ s7 D% U* I2 i4 z( X4 U# O x) |# |" V n1 {9 Y8 |
1 p: T. j6 b4 [/ e4 `瑞萨WPAK封装尺寸* l8 N) u; p# y, N3 }, B: O+ z
. K' E$ I# F; h, `0 d9 y5 TLFPAK和LFPAK-I是瑞萨开发的另外2种与SO-8兼容的小形封装。LFPAK类似D-PAK,但比D-PAK体积小。LFPAK-i是将散热板向上,通过散热片散热。) Q0 `5 w& o+ ]0 ?0 r3 L* C
. Z$ m* b3 d& u: z8 ]& Q \8 Z
9 `( l" v: \; G' D
+ }* L5 K5 b* |. M( K5 h
瑞萨LFPAK和LFPAK-I封装0 g2 g% S1 S5 u& I( [0 d* a
; ]* h& j: J* _# L* K! T7 V
2、威世(Vishay)Power-PAK和Polar-PAK封装
% r! }7 L$ o7 Z' V$ m' f1 j0 J; f
/ Q6 W, @( h( kPower-PAK是威世公司注册的MOSFET封装名称。Power-PAK包括有Power-PAK1212-8、Power-PAK SO-8两种规格。
- u$ y5 ^: e& n" O: Z7 q
3 W2 y6 W/ f% Z( P: r: ]4 b* b( Z( s8 W
* c6 q! L H3 d3 {
威世Power-PAK1212-8封装
o4 D2 ?& V: [8 H8 W' `# [( N8 p: G1 o3 E" B4 J% J
6 Q" d* N" R u. f2 I1 m* v9 L# U3 ~5 T' V1 |
威世Power-PAK SO-8封装# n0 P; H/ \+ s" [* `/ J
. n& S+ y9 H5 HPolar PAK是双面散热的小形封装,也是威世核心封装技术之一。Polar PAK与普通的so-8封装相同,其在封装的上、下两面均设计了散热点,封装内部不易蓄热,能够将工作电流的电流密度提高至SO-8的2倍。目前威世已向意法半导体公司提供Polar PAK技术授权。& i( S4 E3 l3 ]( t
8 [" z& M) C) l* {& Y
# E J; K2 X1 k1 c( p i9 F) A( }( V8 {0 @7 _$ N* K' s
威世Polar PAK封装# S( [/ E2 b8 x
1 ?/ L' J& |2 ?2 T3、安森美(Onsemi)SO-8和WDFN8扁平引脚(Flat Lead)封装
! d" F: A# m0 z f% I: g" e, D; @7 S/ l& q& T
安美森半导体开发了2种扁平引脚的MOSFET,其中SO-8兼容的扁平引脚被很多板卡采用。安森美新近推出的NVMx和NVTx功率MOSFET就采用了紧凑型DFN5(SO-8FL)和WDFN8封装,可最大限度地降低导通损耗,另外还具有低QG和电容,可将驱动器损耗降到最低的特性。
8 ?% J: y7 H9 d2 t; R+ y3 Q5 A1 L, J' v! _4 n/ ~2 f
3 p5 u7 J! s n- u; f! r8 D% K3 E1 N3 _
安森美SO-8扁平引脚封装
1 E4 i( i4 f- q) @# ]6 n8 V1 f5 y2 R0 F
+ G& U: ~( J" e
, T1 U$ T7 F; e4 p
安森美WDFN8封装2 h+ [, M p8 z2 }: Z i4 \7 O
2 U6 N% _8 t+ x/ y% T6 p$ T
4、恩智浦(NXP)LFPAK和QLPAK封装! A& x: Z$ n( y6 i0 H! N5 G3 B
# K! g+ L V9 \* g6 A; p恩智浦(原Philps)对SO-8封装技术改进为LFPAK和QLPAK。其中LFPAK被认为是世界上高度可靠的功率SO-8封装;而QLPAK具有体积小、散热效率更高的特点,与普通SO-8相比,QLPAK占用PCB板的面积为6*5mm,同时热阻为1.5k/W。3 ?5 I# h3 h% `% P$ [
# z0 v& B; A' r" G
恩智浦LFPAK封装
) Y2 t& }- {, t
! g ^- i# U9 [# b7 ]9 E恩智浦QLPAK封装5 X8 h$ [' V6 G$ J$ u$ t
$ W& p( E' j7 u1 T k- A
5、意法(ST)半导体PowerSO-8封装
& j/ i. h1 N) w. O' u6 B4 D+ b! o9 ^$ _% `
意法半导体功率MOSFET芯片封装技术有SO-8、PowerSO-8、PowerFLAT、DirectFET、PolarPAK等,其中PowerSO-8正是SO-8的改进版,此外还有PowerSO-10、PowerSO-20、TO-220FP、H2PAK-2等封装。& {6 {* Z* { V& p$ U; p7 c- x
8 }& @0 b: E# H7 \0 f/ z+ h" @# \
意法半导体Power SO-8封装/ a) e% ^5 L' S) X8 S
" w3 E" L) z3 t% t/ M- P( I
6、飞兆(Fairchild)半导体Power 56封装
3 `3 q8 D: w( a [. u
1 \$ ]" I+ o EPower 56是Farichild的专用称呼,正式名称为DFN 5×6。其封装面积跟常用的TSOP-8不相上下,而薄型封装又节约元件净空高度,底部Thermal-Pad设计降低了热阻,因此很多功率器件厂商都部署了DFN 5×6。
$ |3 v8 t9 s/ v6 C t4 h$ E( G* R! V x# i- E$ e2 `' ^6 i5 ^7 y# L
Fairchild Power 56封装
+ \$ P' q& i' u3 i5 d
0 W) {$ j# y Y# ~# p7、国际整流器(IR)Direct FET封装! C1 z' i7 k4 p1 M% c. q6 R
" z6 w) g# m9 Y* S: q3 DDirect FET能在SO-8或更小占位面积上,提供高效的上部散热,适用于计算机、笔记本电脑、电信和消费电子设备的AC-DC及DC-DC功率转换应用。与标准塑料分立封装相比,DirectFET的金属罐构造具有双面散热功能,因而可有效将高频DC-DC降压式转换器的电流处理能力增加一倍。
- w- l/ p: a% A
* S' Z/ `! M8 q' x% i: y* bDirect FET封装属于反装型,漏极(D)的散热板朝上,并覆盖金属外壳,通过金属外壳散热。Direct FET封装极大地改善了散热,并且占用空间更小,散热良好。
' x) t& M3 X+ y1 H# j3 B: N
* l3 R6 e2 ^: s6 @5 @- Z国际整流器Direct FET封装
( D, r( l: O: G7 O8 o" b2 M+ m
( B3 y& p" b9 U7 \8 h: ]1 H) q3 D2 \$ E, P5 L
]2 a1 ^, h; R; D; PIR Direct FET封装系列部分产品规格( m7 |5 z% j" D6 }$ \) _8 G# U
( T0 B0 J! C4 k/ A* ]- H, }( C2 E>>>>
, v5 I( Q$ E- c" V) g: }3 K, X( O2 t" F/ E
内部封装改进方向! R# R8 ]4 `3 n6 B! M
) s7 o! k8 a' u" {( t0 l, W4 u除了外部封装,基于电子制造对MOS管的需求的变化,内部封装技术也在不断得到改进,这主要从三个方面进行:改进封装内部的互连技术、增加漏极散热板、改变散热的热传导方向。
. `" w: R1 H4 e9 F7 c; o! ]* i
9 \' B3 C% w" t% h. E1、封装内部的互连技术9 `8 T! m6 e7 |6 Y) E6 z# J
5 u3 ~- Z3 Y; I5 d% e* C3 t0 Y7 iTO、D-PAK、SOT、SOP等采用焊线式的内部互连封装技术,当CPU或GPU供电发展到低电压、大电流时代,焊线式的SO-8封装就受到了封装电阻、封装电感、PN结到PCB和外壳热阻等因素的限制。+ T* _% ^% v( w0 y _
* ]7 ^4 M" e; C' n2 j9 f
SO-8内部封装结构2 E9 s2 p. A" q
! a; L& {: m# x, \" I' D
这四种限制对其电学和热学性能有着极大的影响。随着电流密度的提高,MOSFET厂商在采用SO-8尺寸规格时,同步对焊线互连形式进行了改进,用金属带、或金属夹板代替焊线,以降低封装电阻、电感和热阻。
" s8 J4 `3 i* e% d0 u% {
3 H* ^' u0 ]" q. P3 G标准型SO-8与无导线SO-8封装对比
& Q- G0 @5 n& W+ G3 q+ p- x1 }6 y8 o2 ~0 J7 ^* {2 ]$ t3 C
国际整流器(IR)的改进技术称之为Copper Strap;威世(Vishay)称之为Power Connect技术;飞兆半导体则叫做Wireless Package。新技术采用铜带取代焊线后,热阻降低了10-20%,源极至封装的电阻降低了61%。
" P+ b C0 R# X. T! `' q2 \/ ~" S- U. M/ Z+ c( N+ g/ n/ \# r& o
国际整流器的Copper Strap技术
3 S% ~; C4 t5 S4 W* T0 N. t
8 K# O; s* b; m威世的Power Connect技术; u5 h1 d; x- e0 ^% a- g* [
) ]" N" ]* Z$ X7 ?5 x
飞兆半导体的Wirless Package技术
, T& ^( H) M+ I5 i: x& Z' l) T4 s U' f- U
2、增加漏极散热板
$ c9 e, V. `$ l8 P2 {4 b
1 V% {; z+ K s8 Y$ ^标准的SO-8封装采用塑料将芯片包围,低热阻的热传导通路只是芯片到PCB的引脚。而底部紧贴PCB的塑料外壳是热的不良导体,故而影响了漏极的散热。" }: d" }: r- z* ^$ g( H) a/ N
8 C+ f; Z# ]- \ J
技术改进就是要除去引线框下方的塑封化合物,方法是让引线框金属结构直接或加一层金属板与PCB接触,并焊接到PCB焊盘上,这样就提供了更多的散热接触面积,把热量从芯片上带走;同时也可以制成更薄的器件。5 q+ a) A0 J2 d
7 U; ]+ w% T3 a+ P4 Y9 J* Y1 a: ]$ m威世Power-PAK技术
8 u( E( C. O* t. D8 Y# U9 i) |$ t; w0 p% E( D+ O$ r, h
威世的Power-PAK、法意半导体的Power SO-8、安美森半导体的SO-8 Flat Lead、瑞萨的WPAK/LFPAK、飞兆半导体的Power 56和Bottomless Package都采用了此散热技术。
# } _0 d; u! J6 r& @3 y
. P. z& H4 h' Z$ d" [. T3、改变散热的热传导方向
/ Q9 A* f5 n9 t' v
3 W5 z; g( Z1 J0 HPower-PAK的封装虽然显著减小了芯片到PCB的热阻,但当电流需求继续增大时,PCB同时会出现热饱和现象。所以散热技术的进一步改进就是改变散热方向,让芯片的热量传导到散热器而不是PCB。
0 ]4 n/ l% D0 C4 z+ T- m, O6 \! R& n
瑞萨LFPAK-i封装* \+ O0 {7 `$ }( [2 R5 d
( K+ X1 Y* N0 B+ C$ \
瑞萨的LFPAK-I封装、国际整流器的Direct FET封装均是这种散热技术的典型代表。
% ^( v* A2 V) v( X4 ~3 c
7 ]% C3 i. X5 D>>>>4 b% r0 J9 l9 U' B1 d7 i
! ?; c) q! t" e$ {" S" z- q: n1 o
总结
& ^- n+ y; X! c/ i; o/ l( D. \7 T6 v" v! z M ~0 N q/ A+ m
未来,随着电子制造业继续朝着超薄、小型化、低电压、大电流方向的发展,MOS管的外形及内部封装结构也会随之改变,以更好适应制造业的发展需求。另外,为降低电子制造商的选用门槛,MOS管向模块化、系统级封装方向发展的趋势也将越来越明显,产品将从性能、成本等多维度协调发展。
# |6 d- k, G; r' U, H5 e
, `5 N/ x& `: V f, V. z而封装作为MOS管选型的重要参考因素之一,不同的电子产品有不同的电性要求,不同的安装环境也需要匹配的尺寸规格来满足。实际选用中,应在大原则下,根据实际需求情况来做抉择。
# |& j% F" @* ^! O2 m7 q1 h" }5 m# J; V1 S0 \, m* K$ e
有些电子系统受制于PCB的尺寸和内部的高度,如通信系统的模块电源由于高度的限制通常采用DFN5*6、DFN3*3的封装;在有些ACDC的电源中,使用超薄设计或由于外壳的限制,适于装配TO220封装的功率MOS管,此时引脚可直接插到根部,而不适于使用TO247封装的产品;也有些超薄设计需要将器件管脚折弯平放,这会加大MOS管选用的复杂度。; H5 `0 n! }. k0 `2 r5 x) J. [
|
|