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关于压降仿真的问题

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发布时间: 2025-6-23 19:03

正文摘要:

请问大家在power dc中对有反馈的VRM进行压降仿真时,是先正常设置VRM和sink,然后如果仿真超标之后在sense pin这里再加端口进行补偿吗,还是直接再电感后加端口进行仿真! r5 g2 V' @, j5 h) W  T! C

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Dc2025070370a 发表于 2025-7-4 11:05
短路阻抗一般是把端口阻抗改成小电阻(如0.1Ω或者1mΩ)。开路阻抗与短路阻抗的不同主要体现在低频特性上,开路阻抗在低频段趋于无穷大,而短路阻抗则收敛于恒定值。由于VRM和BULK电容并联后输出阻抗在低频段呈现短路特性,因此在工程上短路阻抗分析应用得更普遍一些。
下课逮个鱼 发表于 2025-6-26 18:41
maidoujsjs 发表于 2025-6-26 09:27
! |7 I! y" G0 y5 d+ a3 j! S没仿过短路阻抗,通常只是把端口阻抗改为0.1Ohm
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好的,谢谢& N, k5 z1 |  Q7 Y/ ]
maidoujsjs 发表于 2025-6-26 09:27
下课逮个鱼 发表于 2025-6-25 15:47
4 _% u) O. J8 m0 T短路阻抗不是要将VRM端短路之后仿真才能得到短路时的PDN阻抗吗,对于有反馈的VRM是不是在反馈处设置短路 ...

! R. _# Q; S: w' H没仿过短路阻抗,通常只是把端口阻抗改为0.1Ohm1 ^  r0 j! {9 b$ `

点评

好的,谢谢  详情 回复 发表于 2025-6-26 18:41
下课逮个鱼 发表于 2025-6-25 15:47
maidoujsjs 发表于 2025-6-25 08:45
8 a2 C0 Z& F. |6 ~1.PDN阻抗主要评估的是去耦效果,通常选电感后面。2.PDN短路阻抗,没理解这么操作的理由

( O& [* [6 @, ]短路阻抗不是要将VRM端短路之后仿真才能得到短路时的PDN阻抗吗,对于有反馈的VRM是不是在反馈处设置短路,而不是在VRM的引脚处设置短路然后仿真。

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没仿过短路阻抗,通常只是把端口阻抗改为0.1Ohm  详情 回复 发表于 2025-6-26 09:27
maidoujsjs 发表于 2025-6-25 08:45
下课逮个鱼 发表于 2025-6-24 19:07
+ E0 r+ G0 G, r" G那请问在仿真PDN阻抗的时候,1.对于开路阻抗需要选择电感前的网络吗,还是直接选择电感后的网络。2.仿真 ...
  l$ R' t3 H! Z' Z! }; u; ^
1.PDN阻抗主要评估的是去耦效果,通常选电感后面。2.PDN短路阻抗,没理解这么操作的理由
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短路阻抗不是要将VRM端短路之后仿真才能得到短路时的PDN阻抗吗,对于有反馈的VRM是不是在反馈处设置短路,而不是在VRM的引脚处设置短路然后仿真。  详情 回复 发表于 2025-6-25 15:47
下课逮个鱼 发表于 2025-6-24 19:07
maidoujsjs 发表于 2025-6-24 15:464 m2 r6 D/ G' ?. [- g
2.sense点取决于PCB上,电源网络的物理连接位置

/ m8 z0 z& O% I# s. v2 _2 u: J那请问在仿真PDN阻抗的时候,1.对于开路阻抗需要选择电感前的网络吗,还是直接选择电感后的网络。2.仿真短路PDN阻抗时,直接再反馈处设置VRM仿真就可以吗。7 q2 g" B6 s# Q% m

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1.PDN阻抗主要评估的是去耦效果,通常选电感后面。2.PDN短路阻抗,没理解这么操作的理由  详情 回复 发表于 2025-6-25 08:45
maidoujsjs 发表于 2025-6-24 15:46
maidoujsjs 发表于 2025-6-24 15:45
5 q1 J& j: q  T# S! U7 p, M: J2 d1.先设置sense再仿

/ \# b2 B  |8 o5 {* \2.sense点取决于PCB上,电源网络的物理连接位置
6 R: Z1 m, }$ T( d

点评

那请问在仿真PDN阻抗的时候,1.对于开路阻抗需要选择电感前的网络吗,还是直接选择电感后的网络。2.仿真短路PDN阻抗时,直接再反馈处设置VRM仿真就可以吗。  详情 回复 发表于 2025-6-24 19:07
maidoujsjs 发表于 2025-6-24 15:45
1.先设置sense再仿

点评

2.sense点取决于PCB上,电源网络的物理连接位置  详情 回复 发表于 2025-6-24 15:46
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