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关于压降仿真的问题

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发布时间: 2025-6-23 19:03

正文摘要:

请问大家在power dc中对有反馈的VRM进行压降仿真时,是先正常设置VRM和sink,然后如果仿真超标之后在sense pin这里再加端口进行补偿吗,还是直接再电感后加端口进行仿真/ k( T- _3 z  q+ C! O7 t* E8 |

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Dc2025070370a 发表于 2025-7-4 11:05
短路阻抗一般是把端口阻抗改成小电阻(如0.1Ω或者1mΩ)。开路阻抗与短路阻抗的不同主要体现在低频特性上,开路阻抗在低频段趋于无穷大,而短路阻抗则收敛于恒定值。由于VRM和BULK电容并联后输出阻抗在低频段呈现短路特性,因此在工程上短路阻抗分析应用得更普遍一些。
下课逮个鱼 发表于 2025-6-26 18:41
maidoujsjs 发表于 2025-6-26 09:27, w; r8 f6 _9 t# p, s0 \
没仿过短路阻抗,通常只是把端口阻抗改为0.1Ohm

, t6 y3 g9 I* j5 v3 G8 O好的,谢谢
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maidoujsjs 发表于 2025-6-26 09:27
下课逮个鱼 发表于 2025-6-25 15:47
- C; W! z0 M4 [短路阻抗不是要将VRM端短路之后仿真才能得到短路时的PDN阻抗吗,对于有反馈的VRM是不是在反馈处设置短路 ...
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没仿过短路阻抗,通常只是把端口阻抗改为0.1Ohm
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好的,谢谢  详情 回复 发表于 2025-6-26 18:41
下课逮个鱼 发表于 2025-6-25 15:47
maidoujsjs 发表于 2025-6-25 08:45# Z- i# c9 v/ U5 D/ p/ _6 g* r; B5 O
1.PDN阻抗主要评估的是去耦效果,通常选电感后面。2.PDN短路阻抗,没理解这么操作的理由
/ n& z4 @3 K1 A2 N; s! m1 E
短路阻抗不是要将VRM端短路之后仿真才能得到短路时的PDN阻抗吗,对于有反馈的VRM是不是在反馈处设置短路,而不是在VRM的引脚处设置短路然后仿真。

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没仿过短路阻抗,通常只是把端口阻抗改为0.1Ohm  详情 回复 发表于 2025-6-26 09:27
maidoujsjs 发表于 2025-6-25 08:45
下课逮个鱼 发表于 2025-6-24 19:07
/ z( l" U  F& q那请问在仿真PDN阻抗的时候,1.对于开路阻抗需要选择电感前的网络吗,还是直接选择电感后的网络。2.仿真 ...
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1.PDN阻抗主要评估的是去耦效果,通常选电感后面。2.PDN短路阻抗,没理解这么操作的理由
3 ]6 z- \  U) k) Z0 I' Q

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短路阻抗不是要将VRM端短路之后仿真才能得到短路时的PDN阻抗吗,对于有反馈的VRM是不是在反馈处设置短路,而不是在VRM的引脚处设置短路然后仿真。  详情 回复 发表于 2025-6-25 15:47
下课逮个鱼 发表于 2025-6-24 19:07
maidoujsjs 发表于 2025-6-24 15:46
+ w4 K" L  M0 l' X  {" R2.sense点取决于PCB上,电源网络的物理连接位置
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那请问在仿真PDN阻抗的时候,1.对于开路阻抗需要选择电感前的网络吗,还是直接选择电感后的网络。2.仿真短路PDN阻抗时,直接再反馈处设置VRM仿真就可以吗。
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1.PDN阻抗主要评估的是去耦效果,通常选电感后面。2.PDN短路阻抗,没理解这么操作的理由  详情 回复 发表于 2025-6-25 08:45
maidoujsjs 发表于 2025-6-24 15:46
maidoujsjs 发表于 2025-6-24 15:456 D* Q' W5 @" {1 y7 p4 u
1.先设置sense再仿

/ u( ^; X1 T9 |! ^# J; L2.sense点取决于PCB上,电源网络的物理连接位置
# [8 i0 U- a- v, K! Y

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那请问在仿真PDN阻抗的时候,1.对于开路阻抗需要选择电感前的网络吗,还是直接选择电感后的网络。2.仿真短路PDN阻抗时,直接再反馈处设置VRM仿真就可以吗。  详情 回复 发表于 2025-6-24 19:07
maidoujsjs 发表于 2025-6-24 15:45
1.先设置sense再仿

点评

2.sense点取决于PCB上,电源网络的物理连接位置  详情 回复 发表于 2025-6-24 15:46
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