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Sigirty仿真的目标阻抗为什么刚开始特别大?

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发布时间: 2017-2-24 10:43

正文摘要:

各位大神:Sigirty仿真的目标阻抗为什么会出现椭圆部分?0 O9 w* ]9 Z6 o5 s( _: B* ~. d( `

回复

啊啊啊诺诺诺 发表于 2022-10-19 11:13
icy88 发表于 2017-3-27 13:42
/ Y& L3 ^* ^# w5 e4 M5 `4 N电源芯片那边没有加VRAM模型吧,通常用一个小的电阻等效

3 U' r# n6 d1 r9 f怎么添加的呢,求指导啊
; U; M% n* R9 F
Kaso 发表于 2019-7-10 13:19
学习下,刚接触PI仿真
miaomiao83 发表于 2018-5-14 10:27
阻抗不匹配
miaomiao83 发表于 2018-5-14 10:27
阻抗不匹配
Dai_Xiaolong 发表于 2018-4-9 17:40
icy88 发表于 2017-3-31 15:54
7 z/ U$ |3 t1 n! `' I# q& P2 r* Q看芯片,有的片内去耦做的比较好,板上去耦就很轻松,但是有的厂家没有说明,通常业内默认板上去耦在100m ...

4 T7 B. |) C4 [( h* S! k板级去耦需要做到100~200MHz?这么高,我一般都是做到几十M
6 \" s' e6 n; c" u1 r' M
abcdefg111 发表于 2017-7-21 15:23
学习了!
jmx89 发表于 2017-7-5 00:36
低频不用管,只需关注20~100M就好,VRM短路,低频就很低
xiaoshisanlang 发表于 2017-6-28 19:11
学习了
icy88 发表于 2017-3-31 15:54
DaiXL 发表于 2017-3-31 21:23
. @3 s* g0 z6 {( F) c4 C做PDS阻抗仿真需要做到几百MHz吗?我看intel Romley手册,PCB板级去耦设计只需关注1~2MHz就可以了

; [# `) v2 A  g1 T. C看芯片,有的片内去耦做的比较好,板上去耦就很轻松,但是有的厂家没有说明,通常业内默认板上去耦在100m或200m之前,再大板级去耦就发挥不出效果了

点评

板级去耦需要做到100~200MHz?这么高,我一般都是做到几十M  详情 回复 发表于 2018-4-9 17:40
DaiXL 发表于 2017-3-31 21:23
做PDS阻抗仿真需要做到几百MHz吗?我看intel Romley手册,PCB板级去耦设计只需关注1~2MHz就可以了

点评

看芯片,有的片内去耦做的比较好,板上去耦就很轻松,但是有的厂家没有说明,通常业内默认板上去耦在100m或200m之前,再大板级去耦就发挥不出效果了  详情 回复 发表于 2017-3-31 15:54
icy88 发表于 2017-3-28 10:10
JLP7878 发表于 2017-3-27 15:347 K% j  }+ ?, C' {8 ?: D/ I# d
vrm加上了 但我怀疑软件是不是没有读取?
+ _  @+ C( W& S
那你查下,电源通路中其他地方有开路的地方,如中间的串接电阻,电感之类的没有赋值
* O' L! U! v. s7 |
JLP7878 发表于 2017-3-27 15:34
icy88 发表于 2017-3-27 13:42
+ q2 }/ d& I1 e- Z电源芯片那边没有加VRAM模型吧,通常用一个小的电阻等效

  s4 Z1 d) o3 v3 @4 D- h7 Zvrm加上了 但我怀疑软件是不是没有读取?
' d: k  N1 S6 k1 k. F

点评

那你查下,电源通路中其他地方有开路的地方,如中间的串接电阻,电感之类的没有赋值  详情 回复 发表于 2017-3-28 10:10
icy88 发表于 2017-3-27 13:42
电源芯片那边没有加VRAM模型吧,通常用一个小的电阻等效

点评

怎么添加的呢,求指导啊  详情 回复 发表于 2022-10-19 11:13
vrm加上了 但我怀疑软件是不是没有读取?  详情 回复 发表于 2017-3-27 15:34
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