信号完整性SI/PI仿真今日: 2 |主题: 11924|排名: 8

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[Cadence Sigrity] 求助：SPDLinks转换PCB，文件无效！ 6人参与	EDA520 2021-2-7 17:26	8 1400	皮皮与包包 2021-10-9 15:57
[仿真讨论] 有没有懂IBIS-AMI的大神，想请教一下要设计AMI model的话难不？非常感谢！ 2人参与	limopcb 2021-2-7 17:20	2 777	hyxs714154 2021-2-8 18:58
[资料下载] ★★★★★信號完整性揭秘-于博士SI設計手記 77人参与 ...2 3 4 5 6	Demyar 2021-2-7 14:22	83 9644	电巢er 2025-6-7 10:16
[仿真讨论] 构建交流和直流数据采集信号链 1人参与	srilri2 2021-2-7 14:03	1 679	KIObole 2021-2-7 14:47
[仿真讨论] SPWM波形分析 1人参与	srilri2 2021-2-7 13:57	1 666	QqWw11 2021-2-7 14:43
[Cadence Sigrity] System SI仿真DIMM内存地址信号电平幅值不对 3人参与	硬件小A 2021-2-7 10:41	3 937	Jovian 2023-6-5 19:50
[资料下载] Applying CPM System PI Analysis.pdf	mimiman 2021-2-6 13:23	0 359	mimiman 2021-2-6 13:23
[Cadence Sigrity] cadence sigrity仿真产生端口时有自定义产生端口和手动产生端口，什么情况下手动？... 3人参与	彦彦 2021-2-5 22:47	3 1177	Maxbest 2021-6-7 15:49
[Cadence Sigrity] DDR走线的S参数，S11一般在什么范围比较合理? 7人参与	彦彦 2021-2-5 22:26	6 1025	zyg1060482876 2021-10-18 13:44
[Cadence Sigrity] 用cadence sigrity仿真了4跟线，出现了下图的提示，我电脑是刚买的8G内存的。 10人参与	彦彦 2021-2-5 22:00	11 1988	皮皮与包包 2021-9-17 14:36
[Cadence Sigrity] 使用Sigrity的XtractIM提取封装模型时报错：Failed to generate ports 2人参与	红豆栗子烧 2021-2-5 20:36	2 1000	红豆栗子烧 2021-2-7 10:39
[仿真讨论] ADS中的SDFmodel是什么？ 3人参与	felton 2021-2-5 19:58	3 712	ldezgr 2021-2-16 13:11
[仿真讨论] 第一次用vivado仿真，发现有的模块有信号，有的没有信号。。。 3人参与	Zmb 2021-2-5 16:50	4 635	ldezgr 2021-2-12 12:18
[仿真讨论] 卫星信号模拟器最重要的特点是哪个？ 3人参与	weqewq 2021-2-5 16:48	4 710	ldezgr 2021-2-11 10:45
[资料下载] 信号完整性分析第1版中文版 48人参与 ...2 3 4	gaoxings 2021-2-5 15:46	49 5143	xxj1103 2023-10-25 09:18
[资料下载] Xilinx在LPDDR4的I/O Modeling的研究分享 51人参与 ...2 3 4	Demyar 2021-2-5 13:27	51 4357	physean 2025-4-9 16:37
[Ansys仿真] ansys 安装不成功 3人参与	radioes8 2021-2-4 23:32	9 967	radioes8 2021-2-22 22:06
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[仿真讨论] 电源滤波不够充分，会对抖动产生直接影响吗？ 4人参与	zawq 2021-2-4 11:02	6 697	qwyysfl 2021-2-5 10:29
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为什么做DDR4一拖二的S参数提取时会没有插损呢？ 3人参与	恰巧你在邻桌笑 2021-2-2 17:54	3 667	briantseng 2021-2-3 09:41