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allegro concept hdl 设计线路图检查出错

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发表于 2013-11-12 21:57 | 只看该作者 |只看大图回帖奖励

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大家好，本人学习allegro concept hdl设计线路图，用两个简单的元件设计了一个线路图，元件只有两个脚，对接而已，用 tool/package utilities/electrical rules check 检查总是出错，说是有两个error可是怎么也找不到哪里的问题，有没有高手能帮忙解答呀，在线等。

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发表于 2013-11-13 08:46 | 只看该作者

你把错误贴出来

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TA的每日心情

	开心 2023-10-12 15:00

签到天数: 4 天

[LV.2]偶尔看看I

3^#

发表于 2013-11-13 10:43 | 只看该作者

先file//export physical后才能做这个检查！

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4^#

楼主| 发表于 2013-11-27 19:46 | 只看该作者

flyingc381 发表于 2013-11-13 10:43! o% w& v& i9 q/ G# L
先file//export physical后才能做这个检查！

谢谢你问题解决了，还有个问题请教
我发现我在查询器件的时候，ctrl+f，只能查询net，不能查询元件的location，不知道怎么操作才能搜索器件的location呢，例如我要搜 R1

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发表于 2014-3-30 10:42 | 只看该作者

bobzhu 发表于 2013-11-27 19:466 Z: {! b2 U! B- G% E. N
谢谢你问题解决了，还有个问题请教- t) P; D0 s' n" P% o) e
我发现我在查询器件的时候，ctrl+f，只能查询net，不能查询元件的lo ...

新版本16.5中搜R1就在搜索里填入R1啊，随便搜什么都行
老版本可能是ctrl+f在value中填入R1

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6^#

发表于 2014-4-2 17:10 | 只看该作者

望眼镜那里选parts

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