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allegro等长设置问题

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1#
发表于 2013-8-1 09:54 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
1金币
等长设置好后,显示的长度与实际长度不一致,请问这是什么原因呢???{:soso_e183:}
5 e/ S/ M9 l7 M4 |- U9 s8 \

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去掉下图中的Z Axis Delay即可不包括过孔长度
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    2#
    发表于 2013-8-1 09:54 | 只看该作者
    去掉下图中的Z Axis Delay即可不包括过孔长度+ N0 G  j, U1 G) |

    点评

    支持!: 5.0
    支持!: 5
    谢谢指教。最好说明版本。  发表于 2013-8-6 20:07

    该用户从未签到

    3#
    发表于 2013-8-1 21:27 | 只看该作者
    什么是显示长度,什么是实际长度啊

    该用户从未签到

    4#
     楼主| 发表于 2013-8-2 09:19 | 只看该作者
    李明宗伟 发表于 2013-8-1 21:27 / H$ Z8 Z0 ]  K* ~" V3 F: H
    什么是显示长度,什么是实际长度啊
    8 M" g; A0 n% x% A; p
    show net 的时候显示如下,为什么会出现BOTTOM/BOTTOM,Zall=32 MIL,不知道哪边设置错了
    ) Q1 W1 \" v+ F8 Q3 g/ b1 s5 p1 N- u1 s7 p# E
    1 M* U+ ]8 _3 ?8 u1 C
      Net Name:            XM1_DATA15/ Z6 ?" X  N: C- V+ S- E, t
      Member of Bus:       XM1-D1; j3 n! s3 n1 c- @# d0 U+ u6 [

    ! o. Y0 z/ @3 C* W; o  Pin count:              2
    $ Q/ W( y. J/ Y: j" I9 M  Via count:              4
    # W& Q8 s; P/ }. y( Q7 L: [  Total etch length:      903.28 MIL  5 u3 h# A2 u% t& L, _8 E% ?
      Total manhattan length: 430.73 MIL
    8 M0 N5 j( U4 W4 j; W8 q6 K8 K  Percent manhattan:      209.71%4 I- W4 W0 }" H: N

    9 f! Z! k" \5 d! X: e' n  Pin                     Type      SigNoise Model        Location
    : q  ?4 ?4 X" H0 v  ---                     ----      --------------        --------
    # l, `! J5 i- C6 A& u9 |' p# p, V( v  U4.B9                   UNSPEC                          (-1516.62 685.41)
    ' ], G6 n( T& b( G7 ?3 S  ~$ q  U1.C17                  UNSPEC                          (-1184.58 784.10). n! a, V/ P/ P- X

    : h3 f( h9 s) k( Z  No connections remaining
    5 u3 s& v( \0 N9 ^6 ]. T! {
    7 k  f+ a! C" _1 k$ ?. J  Properties attached to net
    & m/ \% o7 i; |3 T) _1 P    BUS_NAME          = XM1-D1
    * S6 G' e* s0 }, n/ H, w9 w    ELECTRICAL_CONSTRAINT_SET  = XM1_DATA8
    1 k' Q) `* O9 I3 D# Y# X, [+ k/ K
    ; D$ C$ w; O  X: B  Electrical Constraints assigned to net XM1_DATA15
    $ B: `! _% H2 N+ T+ O$ W# W    relative prop delay: global group XM1-D1 from U1.C17 to U4.B9  delta=0.00 MIL  tol=20.00 MIL) m3 ?9 A" }, ^4 ^( z" o7 x

    - T6 n2 d2 }, `9 p2 a; F6 d$ x* a  Constraint information:
    8 H- ]* m( c) K8 m4 F    (RDly) U1.C17 to U4.B9  min= 919.3 MIL  max= 959.3 MIL  actual= 935.28 MIL                   target=  (XM1_DATA12) U1.C18 to U4.D1, Y+ `; V6 R3 P; G7 D4 k
                (-1184.58,784.10) pin U1.C17,UNSPEC,BOTTOM/BOTTOM
    0 S8 u$ r# d( V4 Z# M0 O  X            (-1184.56,784.10) via GND07/BOTTOM- J# |' F% H  Q2 c# c" Q; b
          18.13 MIL cline GND07
    ' q0 r# O. S8 E% L            (-1197.38,771.31) via GND02/GND07
    1 x0 |; \( l: X$ R      639.6 MIL cline ART06: p' e: a; @* E; d3 n
                (-1368.74,567.43) via GND02/GND07: L$ Z+ r+ W# e5 d
          30.94 MIL cline GND07
    + P8 B5 Y. }3 N- \2 {            (-1393.13,581.82) via GND07/BOTTOM* j# y8 T$ |9 Y7 T
          214.59 MIL cline BOTTOM
    4 k$ z2 D8 |. R3 n9 a/ H: o            (-1516.62,685.41) pin U4.B9,UNSPEC,BOTTOM/BOTTOM,Zall=32 MIL
    1 N! V3 @, {* q' v  Member of Groups:
    : V4 y/ D0 u7 W    BUS             : XM1-D1) i# F% _2 p4 l+ m, @0 R& _" O, E

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    5#
    发表于 2013-8-2 09:28 | 只看该作者
    加我QQ739537967,给你看看

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    6#
    发表于 2013-8-2 21:58 | 只看该作者
    Total etch length和Constraint information中的不是同一概念;Total etch length只是走线长度,而Constraint information中的线长还会包括过孔等信息,是综合考虑的延迟。

    该用户从未签到

    7#
     楼主| 发表于 2013-8-5 09:37 | 只看该作者
    李明宗伟 发表于 2013-8-2 21:58
    & M! c# E4 L, u' h* d  STotal etch length和Constraint information中的不是同一概念;Total etch length只是走线长度,而Constrai ...
    ' Z& z4 w' I% u: T& H( i3 B8 H
    那怎样才能在Relative Propagation Delay的Length栏显示的是Total etch length,而不是Constraint information的长度呢?

    该用户从未签到

    8#
    发表于 2013-8-5 17:18 | 只看该作者
    Relative Propagation Delay,如你所见,约束的是延迟,就是我之前所讲的包括过孔在内的所有因素导致的延迟;而如果你只是想约束走线长度的话,可以设置Total Etch Length,不过它不是相对约束。

    该用户从未签到

    9#
     楼主| 发表于 2013-8-6 09:45 | 只看该作者
    李明宗伟 发表于 2013-8-5 17:18
    ' j9 K0 I& o+ u9 I. p; y' k8 \Relative Propagation Delay,如你所见,约束的是延迟,就是我之前所讲的包括过孔在内的所有因素导致的延迟 ...
    # K! m1 V' M$ m" v& `& C
    请问具体要怎么做?在哪边修改?

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    10#
    发表于 2013-8-6 09:55 | 只看该作者
    过孔的长度也算到里面去了,如果通孔板,你看下相差是不是就是板的厚度

    该用户从未签到

    11#
     楼主| 发表于 2013-8-6 10:27 | 只看该作者
    jiaoweiyong 发表于 2013-8-6 09:55
    $ _. A5 x4 S9 N" f; M2 D) u0 Z过孔的长度也算到里面去了,如果通孔板,你看下相差是不是就是板的厚度
    ! n, V: C5 [" \1 g+ M* j
    我要怎样设定,才能不把过孔算在里面呢?{:soso_e183:}

    该用户从未签到

    12#
    发表于 2013-8-6 11:48 | 只看该作者
    tanghui1987510 发表于 2013-8-6 10:27
    - x* @2 }  N- U1 I2 b7 x我要怎样设定,才能不把过孔算在里面呢?

    7 J( |  c/ M. T; G. q% y+ n直接查询不就可以了吗?显示的是走线的长度。

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    13#
    发表于 2013-8-6 11:50 | 只看该作者
    忘记了

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    14#
     楼主| 发表于 2013-8-6 12:45 | 只看该作者
    dzkcool 发表于 2013-8-6 12:21
    & |% P% U2 u" M6 m# L' b1 j去掉下图中的Z Axis Delay即可不包括过孔长度
    " z2 c& G( z3 H0 C, z8 k
    {:soso_e183:} 正解,感谢!!!
  • TA的每日心情
    开心
    2024-7-11 15:39
  • 签到天数: 1 天

    [LV.1]初来乍到

    15#
    发表于 2019-8-8 09:37 | 只看该作者
    设定可以把表层的走线x0.9再记入长度吗
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