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大家更新原理图后导入PCB是怎么处理的

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1#
发表于 2008-7-31 10:29 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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每次修改原理图后,我都要在PCB里面把相关器件给删除掉,要 不然导入网表的时候pads只报错,而不能修改。
7 k& G: \4 j. m1 V" u1 P- L3 a5 D1 O2 }3 ~2 d8 ?8 ]& K
不知道大家有什么好的方法。。
% ]( r5 |- [+ L, o" {3 i% ]; h3 G$ t* w) U  f6 Y- h) F- o
+ ^3 X& y+ C3 Q  a! S8 }
谢谢·~~

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2#
发表于 2008-7-31 10:55 | 只看该作者
用powerlogic

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3#
发表于 2008-7-31 10:56 | 只看该作者
原帖由 liuyu305 于 2008-7-31 10:29 发表
7 t# k6 h; ]6 C: Y0 _: M6 s- }每次修改原理图后,我都要在PCB里面把相关器件给删除掉,要 不然导入网表的时候PADS只报错,而不能修改。6 o) `0 f) Z$ d. `. `' \
6 k" ^  e; ]# J$ y2 o9 B( M
不知道大家有什么好的方法。。1 K# ~  m. ~  P' m( c3 V5 N

& _, j; r1 ?' b8 o5 T& @3 j" Q- e* u2 Y5 x
谢谢·~~

) g/ s& I* J. _9 [: X我也是一样啊,请高手指点,不知怎么不见有人回答; \# r; {% g: o. d/ r8 W
板主很忙吗?
/ r" m" `  ?$ g( [' [5 T2 B还有就是修改了一个封装后要更新,怎么更新才使它变成想要的封装呢

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4#
 楼主| 发表于 2008-7-31 11:46 | 只看该作者
我用的是ORCAD画的原理图6 g' O+ u: O* l6 N& \% v

, j: A5 _) k7 B4 z3 w5 I) r/ S
6 `' X( S' F- R: U( J( ~+ u
3 S2 @8 u  I1 I* _7 s直接修改封装,保存后系统会提示你是否更新封装的

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5#
发表于 2008-7-31 17:29 | 只看该作者
这个问题,是有点复杂,我也不知道怎么搞了。

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6#
发表于 2008-8-3 05:42 | 只看该作者
直接更新是不行的,我是这样做的:# E. C. v9 F' l8 E* M8 E' {
1.将修改好的Orcad原理图导出网表,然后新建一个空的PCB文件导入网表。将导入的PCB保存,不用做任何修改。% K# w5 [# [% l- G; |
2.对需要修改的PCB进行ECO比较,比较的对象就是刚才保存的PCB。确认修改无误后进行Update,注意不要Update Design Rules。这样可以保留现有的PCB并根据原理图进行更新。
# N6 `+ G5 q! W4 @! Q. L! d, F3.需要注意的是更改前点击修改的元件并Unroute attached segments, 断开连接的布线,避免Update时走线被删掉。一般更改网络的布线部分会被删除。

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7#
发表于 2010-5-23 17:21 | 只看该作者
参考

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8#
发表于 2011-4-4 14:45 | 只看该作者
我也不懂

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9#
发表于 2011-4-4 14:50 | 只看该作者
我也不懂
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