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[Cadence Sigrity] 提取的拓扑为什么是这样的,求解,有图?谢谢,

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1#
发表于 2012-11-27 10:24 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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  提取的ADDR与DATA的拓扑,都是这种,! Y0 N; p$ R- `2 ]  Z, r% {

% F0 _" R6 E  ]电阻两边都是分离开来的,为什么会这样,电路连接应该没有错的,
2 A' G6 i5 G9 a电阻用的是分离电阻,不是排阻 ;1 H7 ]. o6 U3 F

1 D! D$ w$ r; F9 o% M谢谢

未命名2.jpg (86.04 KB, 下载次数: 0)

未命名2.jpg

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2#
 楼主| 发表于 2012-11-27 11:51 | 只看该作者
好像查出原因了,
2 `' U3 _$ \& N: ^: Z9 r2 _# O好像是

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3#
 楼主| 发表于 2012-11-27 11:53 | 只看该作者
我的XNET没有设置好,谢谢

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4#
发表于 2012-12-4 08:38 | 只看该作者
了解
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