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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › 提取的拓扑为什么是这样的，求解，有图？谢谢，
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[Cadence Sigrity] 提取的拓扑为什么是这样的，求解，有图？谢谢，

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南林维京

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1#
发表于 2012-11-27 10:24 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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  提取的ADDR与DATA的拓扑，都是这种，
" z  V2 ]( n3 B* U7 y& p5 ~
3 w2 K0 k' ^9 w, x) r3 F7 u; i# m4 U8 K9 h电阻两边都是分离开来的，为什么会这样，电路连接应该没有错的，
+ B- m" N8 N# J3 M/ X电阻用的是分离电阻，不是排阻 ；! x" Z8 L+ V* `: t1 a7 v6 m+ k, j

. ~7 @9 Y- A0 ^7 E/ p* d, `谢谢

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南林维京

该用户从未签到
2#
 楼主| 发表于 2012-11-27 11:51 | 只看该作者
好像查出原因了，' c3 o" i2 ]5 G, q' e0 A
好像是

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南林维京

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3#
 楼主| 发表于 2012-11-27 11:53 | 只看该作者
我的XNET没有设置好，谢谢

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qqtolm

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4#
发表于 2012-12-4 08:38 | 只看该作者
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