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[Cadence Sigrity] 提取的拓扑为什么是这样的，求解，有图？谢谢，

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发表于 2012-11-27 10:24 | 只看该作者 |只看大图回帖奖励

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提取的ADDR与DATA的拓扑，都是这种，

电阻两边都是分离开来的，为什么会这样，电路连接应该没有错的，
电阻用的是分离电阻，不是排阻；

谢谢

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楼主| 发表于 2012-11-27 11:51 | 只看该作者

好像查出原因了，
好像是

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3^#

楼主| 发表于 2012-11-27 11:53 | 只看该作者

我的XNET没有设置好，谢谢

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4^#

发表于 2012-12-4 08:38 | 只看该作者

了解

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