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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › allegro的DDR上下拉电阻端不计算长的规则怎样设？
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allegro的DDR上下拉电阻端不计算长的规则怎样设？

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小小技术员
  • TA的每日心情
    慵懒
    2026-2-25 15:04

    • 签到天数: 32 天

    [LV.5]常住居民I
     楼主| 发表于 2026-3-10 11:48 | 显示全部楼层 |阅读模式

    EDA365欢迎您登录！

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    我在网上搜这个DDR电阻端的走线长度不计算等长的规则里，目前没有找到！有哪位大神知道的求大神为小弟解答一下。非常感谢！祝大佬们多多爆单。

    下载资料威望不够？点击查看获取威望的N种方法>>
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    athena_lu
  • TA的每日心情
    郁闷
    2026-4-15 15:22

    • 签到天数: 203 天

    [LV.7]常住居民III
    发表于 2026-3-10 15:28 | 显示全部楼层
    sigxplorer里定义 pin pair。

    下载资料威望不够？点击查看获取威望的N种方法>>
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