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ddr3的板子如何确定叠层

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  • TA的每日心情
    开心
    2025-6-18 15:02
  • 签到天数: 1 天

    [LV.1]初来乍到

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    1#
     楼主| 发表于 2025-6-18 16:58 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    请教一个问题,关于有ddr3的板子如果,确定叠层,哪个层走什么信号,需要几次板?
  • TA的每日心情
    擦汗
    2024-5-14 15:27
  • 签到天数: 1 天

    [LV.1]初来乍到

    2#
    发表于 2025-6-19 09:17 | 只看该作者
    看你是几层板,几颗ddr,什么拓扑
  • TA的每日心情
    开心
    2025-6-18 15:02
  • 签到天数: 1 天

    [LV.1]初来乍到

    3#
     楼主| 发表于 2025-6-25 10:26 | 只看该作者
    内层阻抗线,计算阻抗是要考虑上下参考层,上下都要是电源或地平面吗?两片ddr3,打算走fly-bye拓扑,8层板。看这个叠层是不是有问题?
  • TA的每日心情
    开心
    2025-6-18 15:02
  • 签到天数: 1 天

    [LV.1]初来乍到

    4#
     楼主| 发表于 2025-6-25 10:29 | 只看该作者
    内层阻抗线,计算阻抗是要考虑上下参考层,上下都要是电源或地平面吗?两片ddr3,打算走fly-bye拓扑,8层板。看这个叠层是不是有问题?1 [+ z7 X, H9 I! v

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