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新手求教DDR2分组

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1#
发表于 2012-10-20 11:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
2金币
高手好  我是新手正在学   能帮我分下组吗??  ADD   DAT  CLK   CS     DQS   LDM UDM   这些线的规则和相互间 线长的关系  附件为SCH  OR16.5和PDF的    望抽空指点为谢
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, K, z; z5 P( X3 P

3 A. J- e: g3 M4 o0 v! f MEM_DDR2 求教高手这个图咱分组.pdf 5 v: x- {3 j8 O2 ~
2012-10-20 10:15 上传
8 A+ {2 j) I: O点击文件名下载附件
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5 {  B4 ^) s5 I/ C9 l! C+ ~5 c
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DDR.rar

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MEM_DDR2 求教高手这个图咱分组.pdf

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1、地址、控制、时钟为一组,时钟走差分线,本组信号围绕时钟差分做正负25mils误差等长; 2、DATA0-DATA7、DQM0、#DQS0/DQS0为一组,#DQS0/DQS0差分布线,本组信号围绕#DQS0/DQS0差分做正负15mils误差等长; 3、DATA8-DATA15、DQM1、#DQS1/DQS1为一组,#DQS1/DQS1差分布线,本组信号围绕#DQS1/DQS1差分做正负15mils误差等长; 4、DATA0-DATA7、DQM2、#DQS2/DQS2为一组,#DQS2/DQS2差分布线,本组信号围绕#DQS2/DQS2差分做正负15 ...

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2#
发表于 2012-10-20 11:30 | 只看该作者
1、地址、控制、时钟为一组,时钟走差分线,本组信号围绕时钟差分做正负25mils误差等长;
1 ?8 _5 N' X+ ]6 A+ e, J: z" a) O! c* C% R2、DATA0-DATA7、DQM0、#DQS0/DQS0为一组,#DQS0/DQS0差分布线,本组信号围绕#DQS0/DQS0差分做正负15mils误差等长;
* g- r9 P, @& C6 @3、DATA8-DATA15、DQM1、#DQS1/DQS1为一组,#DQS1/DQS1差分布线,本组信号围绕#DQS1/DQS1差分做正负15mils误差等长;6 {- k5 j! d# N7 s" Z; J7 C+ V
4、DATA0-DATA7、DQM2、#DQS2/DQS2为一组,#DQS2/DQS2差分布线,本组信号围绕#DQS2/DQS2差分做正负15mils误差等长;0 d6 c9 {3 O: k! m% S5 @
5、DATA8-DATA15、DQM3、#DQS3/DQS3为一组,#DQS3/DQS3差分布线,本组信号围绕#DQS3/DQS3差分做正负15mils误差等长;
4 L& C; |3 Q* g7 n( a  f) o6、以上说有数据误差在正负15mils内,数据组与地址控制组误差在500mils内,所有差分对内误差5mils;6 v) X9 i, Q. \

; y; c  I, J3 i- U5 J5 e7 w" o' L4 d5 Y
7 P( {! O2 w* I
两片DDR的数据网络命名重叠了,应该一片为M0_DATA,一片为M1_DATA

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3#
发表于 2013-1-3 17:28 | 只看该作者
数据同组同层走线

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4#
 楼主| 发表于 2013-1-3 22:45 | 只看该作者
本帖最后由 qyl9898 于 2013-1-3 23:01 编辑 " K2 h3 q: J5 T6 O; ~; T3 |
dhgchina 发表于 2013-1-3 17:27 ; ^* c2 @. l: X# R2 E
1、地址、控制、时钟为一组,时钟走差分线,本组信号围绕时钟差分做正负25mils误差等长;
0 v: J& Y$ [6 c2 _% N, m* y! O2、DATA0-DATA7、 ...
* A8 O. s- ~$ N3 B6 t0 E8 y4 A
! A2 K0 o5 `" M- m# t
他data 0-31的,有两组(四片)6 {( R. C" P0 ]# ~: U- }2 p
/ \. n' b8 x! O3 f5 _6 \- M, b
再弱弱的问个问题,ADDR 0-13怎么才能从两DDR的中间布线到MCU如下图上部分的地址线
$ z- F  X% D9 O/ L  Z; T( j, S
8 S8 i2 b% [$ a3 b# Q3 [附了5.0的ASC文件,请指点下

未命名.jpg (205.21 KB, 下载次数: 3)

下图怎么走成这样

下图怎么走成这样

未命名1.jpg (131.52 KB, 下载次数: 0)

未命名1.jpg

复件 S5PV210.rar

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5#
发表于 2013-1-4 08:30 | 只看该作者
qyl9898 发表于 2013-1-3 22:45 ) p% s; }2 n  `& _
他data 0-31的,有两组(四片)  d4 g/ I6 s( q
2 M% c9 P* f, }2 f
再弱弱的问个问题,ADDR 0-13怎么才能从两DDR的中间布线到MCU如下 ...

7 Z( J5 U' q9 x) P( P. S两片DDR相对CPU对称布局,要预留等长空间,首先将一片DDR的过孔扇好,然后复制线孔直接粘贴到另一片DDR,保证两片DDR扇孔一致,然后将T点放在两端扇孔的中点

2013-01-04_082955.jpg (166.33 KB, 下载次数: 2)

2013-01-04_082955.jpg

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给力  发表于 2013-1-31 21:39

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6#
发表于 2013-1-4 08:39 | 只看该作者
上图仅限十层(四个内层以下)以下PCB,若信号层充足可照数据那样正常扇出即可,只需将T点放在中间

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7#
发表于 2013-1-30 22:27 | 只看该作者
两片DDR相对CPU对称布局

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8#
发表于 2013-1-31 20:16 | 只看该作者
给力
  C2 h% {. ~: l/ b7 H3 G: O

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9#
发表于 2013-2-2 15:45 | 只看该作者
非常好,有文字有图

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10#
发表于 2013-2-5 10:35 | 只看该作者
qyl9898 发表于 2013-1-3 22:45 / `& c# h6 A2 N  g4 m( _3 U
他data 0-31的,有两组(四片)
% `/ `) y5 {3 Q3 B7 F; J0 C8 F! r; @( v+ a. H2 U
再弱弱的问个问题,ADDR 0-13怎么才能从两DDR的中间布线到MCU如下 ...

3 Y7 K' t3 O& }% P& |" t请问有原理图吗,大侠,zhouguanhua125@163.com

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11#
发表于 2013-2-13 22:05 | 只看该作者
谢谢分享了,学习中

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12#
发表于 2013-2-14 16:55 | 只看该作者
这是我的画法:/ T9 Z# j% ?5 x8 [* O6 T
1、地址、控制、时钟为一组,时钟走差分线,本组信号围绕时钟差分做正负25mils误差等长; 3 @1 y8 {5 d& ~8 @
..............................................
& @: Z/ ?) w9 t7 J$ I' v6 L8 r, O4 q2、DATA0-DATA7、DQM0、#DQS0/DQS0为一组,#DQS0/DQS0差分布线,本组信号围绕#DQS0/DQS0差分做正负15mils误差等长;
" l9 L1 _' x- b/ i............................................... 9 S1 k2 P% ]& u2 h' ^
3、DATA8-DATA15、DQM1、#DQS1/DQS1为一组,#DQS1/DQS1差分布线,本组信号围绕#DQS1/DQS1差分做正负15mils误差等长;
5 [! U! I; L/ L................................................... ) H3 V; {6 \* c- j$ @* T! \7 k9 g
4、DATA16-DATA23、DQM2、#DQS2/DQS2为一组,#DQS2/DQS2差分布线,本组信号围绕#DQS2/DQS2差分做正负15mils误差等长;
3 a8 X# o% [7 j6 i+ K# ~......................................................
4 m8 Z. e* |( ~3、DATA24-DATA31、DQM3、#DQS3/DQS3为一组,#DQS3/DQS3差分布线,本组信号围绕#DQS3/DQS3差分做正负15mils误差等长;
6 G- f2 b+ u! D5 }! l.................................................+ _, @# v& y8 x, k

8 E. T) z. _3 L% w6 [完成!

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