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DDR区域规则设置问题

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  • TA的每日心情
    奋斗
    2024-9-9 15:39
  • 签到天数: 2 天

    [LV.1]初来乍到

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    1#
     楼主| 发表于 2024-7-9 11:35 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    DDR区域规则设置的时候,由于BGA区域出线的限制,设置区域规则的时候,线宽线距的依据是什么? neck 模式中能保证达到阻抗的要求吗?
    5 H. ^9 l1 [5 _7 ~6 h9 [0 [% q8 v

    1720495812863.png (23.35 KB, 下载次数: 2)

    1720495812863.png
  • TA的每日心情
    擦汗
    2024-5-14 15:27
  • 签到天数: 1 天

    [LV.1]初来乍到

    2#
    发表于 2024-7-9 13:40 | 只看该作者
    本人做法依据是:在板厂加工能力允许范围,尽可能减小阻抗误差(一般阻抗加工误差是±10%);( q/ s$ T+ S" ]* ]7 q; v( z7 F! @8 v& D
    neck模式,一般不能达到阻抗要求,但可以简单计算或者仿真最大允许neck长度,在范围内都是可以接受的;1 O' T" ]5 v  u. n! @( `, J, m" ]
    头像被屏蔽
  • TA的每日心情
    开心
    2025-1-23 15:05
  • 签到天数: 17 天

    [LV.4]偶尔看看III

    3#
    发表于 2024-7-9 14:29 | 只看该作者
    提示: 作者被禁止或删除 内容自动屏蔽
  • TA的每日心情
    奋斗
    2024-9-9 15:39
  • 签到天数: 2 天

    [LV.1]初来乍到

    4#
     楼主| 发表于 2024-7-15 17:25 | 只看该作者
    aarom 发表于 2024-07-09 14:29:35
    1 K4 \1 K& v; e, h不專業的.
    + z( X! {4 {' H! I$ S8 q  ]1.BGA出線設 neck模式 或 限制區域.
      a  O3 ~0 H) s7 i! ~- z8 Y   無法達到阻抗要求, 以能出線為主.
    : F, ~' s  u' g$ x) y, Q# ^! d
    * m6 w% n5 o' {2.出線至正常區域,線寬線距回到正常.
    2 ^0 J8 l- H1 Q* q, L# J7 H: o0 v! Q) I. n/ L. w0 @4 o
    專業的.
    , `/ D1 ^( P$ [1.BGA出線設 neck模式 或 限制區域. 再以 tabbed routing 補償.9 D7 u$ Z7 p8 Y+ ^$ ^+ [) C

    2 _4 {4 _2 I! k2 t  k- x  A. s" n( K2.出線至正常區域,線寬線距回到正常.
    9 c1 C% R5 P, E: i: ^2 Z

    " _# K2 V, i; l/ O; D每一段还有不同的阻抗要求,不过通过补偿,就不用分的那么清楚了,感谢大神解答。- U7 ]) R7 B5 Z. b2 B5 K$ Q

    “来自电巢APP”

  • TA的每日心情
    奋斗
    2024-9-9 15:39
  • 签到天数: 2 天

    [LV.1]初来乍到

    5#
     楼主| 发表于 2024-7-15 17:27 | 只看该作者
    wen11902 发表于 2024-07-09 13:40:21
    2 y2 A. S4 E1 f3 E& Q7 ?! }, \7 Y% n本人做法依据是:在板厂加工能力允许范围,尽可能减小阻抗误差(一般阻抗加工误差是±10%);
    " ]& X' r" K6 e5 Q+ wneck模式,一般不能达到阻抗要求,但可以简单计算或者仿真最大允许neck长度,在范围内都是可以接受的;
    0 D3 \7 _8 T4 Y& l3 \6 b* V
    5 h5 k& \6 N- a. v4 X' ]
    还需要提前仿真吗,这部分操作确实没有仿真过。就是看了资料说,可以分段管控阻抗,不过还是要以出线为主。
    3 v' b) G8 ~6 O

    “来自电巢APP”

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