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EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › 用逻辑门画出 D 触发器和RS触发器
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用逻辑门画出 D 触发器和RS触发器

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dragongfly

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1#
发表于 2023-2-27 09:59 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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用逻辑门画出 D 触发器和RS触发器9 H; h0 \( S0 F

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Maskman

该用户从未签到
2#
发表于 2023-2-27 11:38 | 只看该作者
基本D触发器* o. s1 M$ i9 G5 R1 G" E- _, x

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风吹过后

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3#
发表于 2023-2-27 11:55 | 只看该作者
CP = 0时，触发器状态保持不变；CP = 1时，触发器的输出端接收输入端D的数据，保存在输出端
0 d- K0 Y* v, p8 q1 f: @1 N0 { $ o# g7 W. K0 q7 g2 ^

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