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DDR数据

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该用户从未签到

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1#
发表于 2012-1-8 23:23 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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请兄弟们帮忙查看附图,数据走线长度是否有什么问题?

DDR.png (12.21 KB, 下载次数: 3)

DDR.png

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2#
 楼主| 发表于 2012-1-8 23:26 | 只看该作者
是DDR2芯片,由于板子面积问题,地址线误差较大,这样有没有影响?

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3#
发表于 2012-1-9 14:16 | 只看该作者
个人认为,没啥大影响,

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4#
 楼主| 发表于 2012-1-9 22:53 | 只看该作者
谢谢楼上,请大家多帮忙评评

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5#
发表于 2012-1-10 07:54 | 只看该作者
要看是DDR1还是DDR2,3吧,一般的DDR1可以做+-100mil的地址误差,2 3 就不推荐做这么大的

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6#
 楼主| 发表于 2012-1-10 20:53 | 只看该作者
现在是DDR2芯片,请高手们帮看看啊

该用户从未签到

7#
发表于 2012-1-10 21:40 | 只看该作者
本帖最后由 心悦神 于 2012-1-10 21:42 编辑 & D2 w1 S5 v& E! [

' g/ v$ X) F) Z  l: D* k我几个月前画的一块板子用的是DDR3内存,用了四片内存,总容量为1GB,由于内存摆放位置比较靠近CPU,所以当时地址线长度比较短,在650左右,所有数据线长度都在640到650之间,长度控制得比较狠,目前我们的板子测试得到最高位460Mhz,而我们需求的是400Mhz,余量还是比较大的,但是感觉还是没有想象中的高

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8#
 楼主| 发表于 2012-1-11 00:09 | 只看该作者
那还照楼主的经验,我这个数据会不会有什么影响,因为板子面积问题,地址线拉出来直走就那么长了,因为现在地址线与数据线相差还是有些大的,但看到有的板子,批量过的,也是DDR2,误会差有的达到了700MIL,也没发现有什么问题,困惑中。。。

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9#
 楼主| 发表于 2012-1-11 22:45 | 只看该作者
兄弟们发表一下意见啊

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10#
发表于 2012-1-12 15:49 | 只看该作者
个人认为,做技术不能存在侥幸心理,不能因为别人的PCB走线误差大能跑起来,就觉得自己这样走也OK,严格按照LAYOUT GUIDE来布线还是很有必要的,不怕一万,就怕万一

该用户从未签到

11#
发表于 2012-1-12 15:56 | 只看该作者
心悦神 发表于 2012-1-10 21:40
; U/ U4 r5 ]6 J! @我几个月前画的一块板子用的是DDR3内存,用了四片内存,总容量为1GB,由于内存摆放位置比较靠近CPU,所以当 ...
7 P* W/ ^5 g  j$ @% l8 }
控制的真够很的,发张照片看看,拜读一下!!!!

该用户从未签到

12#
发表于 2012-1-12 16:14 | 只看该作者
DDR2的最大工作频率是533MHz,也就是说周期是不到2ns。所以差200mil应该是没有问题的。

该用户从未签到

13#
 楼主| 发表于 2012-1-12 23:06 | 只看该作者
感谢楼上几位的回复,lisa说的也是,不能因为别人的PCB走线误差大能跑起来,就觉得自己这样走也OK,现在正在想办法更改下,争取误差控制在+-100MIL之间,同组信号误差控制在+-5MIL之间
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