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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 导入网表后出现的错误，帮忙看下
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导入网表后出现的错误，帮忙看下

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xupeng1002

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1#
发表于 2011-12-12 16:45 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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之前都是好好的，我不知道动了什么，再倒入就出现“unable to find net name”的错误7 T6 g! [6 A3 Y% `5 s" Y
相同的网表倒到别的pcb图就没问题6 x# E+ m) j4 y8 z' o: x$ h
所以应该不是网表的问题4 c9 }6 d, O7 Z7 L  T+ z$ r/ {
. p) [- H: [3 c$ o  E) }
求解！

下载资料威望不够？点击查看获取威望的N种方法>>
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