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[Cadence Sigrity] 【求助】提取差分对拓扑

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发表于 2011-5-25 18:20 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 jjcc654321 于 2011-5-25 18:28 编辑 ( i2 M2 U* u  _& [, K! U% `) z
. g. K3 |+ D6 E9 g5 z4 R
为什么提取的拓扑走线不能提取为那种差分格式的呢?! q0 E$ ?3 g" I
我用的是16.2版本的!
" U1 j: R, W) w& \$ T0 z% n高手帮忙给看下,谢谢!!!
6 a6 \( |+ v  x7 w

{BC3B3A2B-D5D4-4242-A455-11CCA265B359}.jpg (66.85 KB, 下载次数: 6)

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    2#
    发表于 2011-5-26 12:16 | 只看该作者
    这不就是差分格式吗?

    该用户从未签到

    3#
     楼主| 发表于 2011-5-26 17:08 | 只看该作者
    怎么设置下提取出的拓扑里的走线是耦合线?

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    4#
     楼主| 发表于 2011-6-3 17:31 | 只看该作者
    在constraint manager---->tools---->options中选中automatic topology update;include routed interconnect;schedule based on routed interconnect
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