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[Cadence Sigrity] sigrity仿真波形不收敛

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1#
发表于 2021-6-25 22:19 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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遇到一个问题,用sigrity2016中的system si进行DDR仿真,地址线可以正常出波形和眼图。但是同样的案例,用sigrity2018或者sigrity2019跑仿真,仿真过程中就直接退出或者跑出来的地址线波形不收敛。请问大家遇见过这种问题么?
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    2#
    发表于 2021-6-26 19:48 | 只看该作者
    用PowerSI提取的S参数模型就容易这样,可以勾上强制无源试试

    该用户从未签到

    3#
     楼主| 发表于 2021-6-26 23:32 来自手机 | 只看该作者
    谢谢杜老师,那我再从新提取s参数试试看。

    该用户从未签到

    4#
     楼主| 发表于 2021-6-26 23:40 | 只看该作者
    另外,还得请教杜老师,强制无源具体是勾选哪个选项呢?谢谢

    该用户从未签到

    5#
     楼主| 发表于 2021-6-27 00:06 来自手机 | 只看该作者
    杜老师,是截图里,划线这个位置直接勾选上么?

    Screenshot_20210627_000522.jpg (14.13 KB, 下载次数: 0)

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    6#
    发表于 2021-6-27 11:24 | 只看该作者
    电巢学堂的仿真实训营有视频课程讲解
    7 B9 D. Z. h2 e1 [EDA技术公社微信公众号里面也有操作介绍
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