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[Cadence Sigrity] DDR仿真,眼图,sigrity

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该用户从未签到

16#
发表于 2022-9-6 17:14 | 只看该作者
a422877308 发表于 2022-8-10 17:36
& x$ c4 x4 ?" K! ~* f/ O# y8 p7 B/ B通常来讲,控制器端的眼图(读)要比DRAM颗粒端的眼图(写)质量要好。这主要是PDN的影响,控制器端的PDN往 ...

+ e1 K' s3 C( ~3 I0 ]: C控制器端的PDN差一些,眼图要好?
3 W/ H- U$ \# C

点评

什么理解水平呀  详情 回复 发表于 2022-9-14 21:55

该用户从未签到

17#
发表于 2022-9-14 21:55 | 只看该作者
1120359104 发表于 2022-9-6 17:143 T3 F! _9 V( t
控制器端的PDN差一些,眼图要好?
, R9 _0 L8 X6 O4 \6 ~" [6 H0 g
什么理解水平呀

该用户从未签到

18#
发表于 2022-11-9 09:17 | 只看该作者
你可爱的老爷 发表于 2020-12-16 20:09
0 b8 [1 k# }2 J* V3 O, n) N速率不一像 采样叠加的眼图大小就不一样,眼图看整正常睁开 基本就没有问题
) q4 {# i, i  f
DDR3的clk单根波形是这样是啥原因呀
4 @7 z( R8 }& T+ K3 L& P

ddr.jpg (37.66 KB, 下载次数: 0)

ddr.jpg

点评

波形负责很小,对比幅值1.4v的那个是CKE的  详情 回复 发表于 2022-11-9 09:18

该用户从未签到

19#
发表于 2022-11-9 09:18 | 只看该作者
1120359104 发表于 2022-11-9 09:17* H/ T6 N4 E7 W# `$ h
DDR3的clk单根波形是这样是啥原因呀

) ^+ u+ F( [2 H* Q# g" u波形负责很小,对比幅值1.4v的那个是CKE的
# A! Z. j! j& {' E- Q
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