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为什么PCB电源部分的电感和mos管所在的区域不允许走线

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1#
发表于 2010-10-27 15:52 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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开关电源的MOS管和电感所在的位置不同层面为什么不能走线& Z5 E+ ?. D( ~! ?
即使我的第2层是完整的GND,有联系吗
7 j( ]+ Q3 b1 p0 p2 V  t3 ~% d

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发表于 2010-10-28 11:00 | 只看该作者
首先这两个器件是干扰源,不推荐走线,没必要冒这个风险。
1 i7 N4 y/ t4 r; E- y/ h5 H/ f9 j6 b. J' Z) A
即使你参考层是地信号,理论上是屏蔽了,不过还有2点需要考虑2 q, C2 y1 ^+ I) P
1:地平面上是否会抖动,根据感性理论,如果上面的电感在震荡,通常会产生相反的电流流向在地平面上; q3 a8 {* Y, B) L- u
2:这2个器件都是升温器件,这样你对应的板材介电常数以及铜线都会发生变化,对应点的阻抗也就变化了,低速还可以,高速就值得冒险。

点评

支持!: 5.0
支持,加上4楼的答案就更完整了  发表于 2013-3-16 20:53
支持!: 5
不错!  发表于 2013-1-11 00:17

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发表于 2015-1-12 17:21 | 只看该作者
貌似是这个phase地方的电源不是很干净,所以建议这个地方的器件和铜箔下面不允许走线,内部各层都不可以,而且尽量让其他信号线远离这个地方!个人经验谈,理论懂太少,仅供参考。

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发表于 2015-1-21 14:51 | 只看该作者
liqiangln 发表于 2010-10-28 11:008 W: h1 Q$ Z, v8 q7 b& w* c- ^
首先这两个器件是干扰源,不推荐走线,没必要冒这个风险。
5 g4 o6 }7 W( v' \$ s6 I, \0 x6 V) o
即使你参考层是地信号,理论上是屏蔽了,不过 ...

% k. d! ]. I7 d赞一个
& f; [/ I2 x  e' ]

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3#
发表于 2010-11-5 16:17 | 只看该作者
学习学习。

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4#
发表于 2010-11-10 19:16 | 只看该作者
1.走线会造成phase点铜皮的不完整性,造成low side mosfet漏极尖峰的加剧,劣化EMI
7 S6 o4 m1 q$ D2 U2.开关噪声会耦合到走线上

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5#
发表于 2010-12-21 23:08 | 只看该作者
study  study

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6#
发表于 2010-12-22 15:51 | 只看该作者
学习学习了

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7#
发表于 2010-12-23 13:30 | 只看该作者
恩 恩
  • TA的每日心情
    郁闷
    2025-4-28 15:02
  • 签到天数: 13 天

    [LV.3]偶尔看看II

    8#
    发表于 2011-1-4 10:17 | 只看该作者
    学习了,前一段时间我们设计的PCB就出了由于这个原因产生视频干扰问题!!!

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    9#
    发表于 2011-1-4 10:56 | 只看该作者
    O(∩_∩)O谢谢!  k3 ^2 e3 ^: d9 l; a

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    10#
    发表于 2011-1-5 13:41 | 只看该作者

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    11#
    发表于 2011-8-27 11:14 | 只看该作者
    那在电感下面过孔可不可以呀???

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    12#
    发表于 2011-10-1 12:27 | 只看该作者
    学习了

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    13#
    发表于 2011-10-1 13:32 | 只看该作者
    支持 楼上观点

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    14#
    发表于 2011-10-8 16:31 | 只看该作者
    study

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    15#
    发表于 2011-10-9 10:41 | 只看该作者
    类似于晶振、晶体的处理方法,因为表层走线会受到器件的产生的电磁干扰
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