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请大家谈下PCB过静电时LAYOUT的经验和要求

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1#
发表于 2010-10-27 10:37 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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PCB在LAYOUT时,过静电是很烦的事,各接口电路处理不好,线走得长或弯的角度不好等都会引起在打静电时通不过,请各位大侠谈下这方面的经验.

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2#
发表于 2010-10-28 13:14 | 只看该作者
重要信号要注意,碰到过reset线容易被打挂

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3#
发表于 2010-10-28 13:42 | 只看该作者
https://www.eda365.com/forum-view ... -highlight-ESD.html

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4#
发表于 2010-12-17 10:13 | 只看该作者
进来学习!谢谢版主

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5#
发表于 2010-12-31 11:38 | 只看该作者
学习了
2 Q5 k3 t( P7 @( Q* U

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6#
发表于 2011-1-5 21:58 | 只看该作者
学习中
- r$ Q: \7 p% V, Q. k3 \" }% r~~~~~~~~~~~~

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7#
发表于 2011-4-29 16:48 | 只看该作者
希望由高手解答

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8#
发表于 2011-4-29 17:40 | 只看该作者
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