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做FPGA上板测试时候很难定位问题,大家怎么解决的?

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    2024-12-19 15:41
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    [LV.5]常住居民I

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    1#
    发表于 2010-2-22 11:22 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    如果仿真做的不全,在FPGA上板测试的时候问题很难解决,大家是怎么做的呢?是不是先花很多时间搭建仿真环境,做足了仿真才上板测试,还是直接上板测试?一般开发一款FPGA需要几个人,一个人就可以了吗?

    该用户从未签到

    2#
    发表于 2010-2-24 16:38 | 只看该作者
    都有相应的在线调试工具的,我是用XILINX的,所以有CHIPSCOPE这个工具,可以看见你RTL代码中的几乎所有的线网和寄存器.
    ( R$ Y  N4 ?1 n  V, N* I8 F还有,用仔细用Modelsim做功能仿真很重要的,如果仿真做的好,调试的时候,基本上不用怀疑FPGA会不正常,而是去检查其他与FPGA相连的器件或! h. H6 s, N1 z; x7 d* S
    PCB的问题.# q$ l- h- Y* c& s  ~
    一般一个50万门以下的设计是一个人是能胜任的,如果用FPGA使用软核跑嵌入式,那么再大的FPGA都不成问题,设计的主要焦点编程写C语言了
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    [LV.5]常住居民I

    3#
     楼主| 发表于 2010-2-25 11:44 | 只看该作者
    多谢了

    该用户从未签到

    4#
    发表于 2010-2-26 09:37 | 只看该作者
    本帖最后由 51video 于 2010-2-26 09:49 编辑 % i7 c" N  ?! f) A9 K+ R
    % ^) r/ P2 I4 N
    建议先仿真,再上板子调,仿真都不过,调试肯定不可能过了。6 p) k/ J4 T2 D6 |! D

      y" D6 a& |9 H* Q# N楼上的介绍了XILINX的,我是用ALTERA的,我也来说说ALTERA的,+ I6 s/ j  N' [: W" a: r1 |; }
    硬debug这事情比较灵活,方法较多,可以在硬件设计时候多拉几个测试点,然后用逻辑分析仪等进行验证;
    8 k4 M' H4 C: D% q或者软debug方面,ALTERA的singnalTap II蛮不错的,如果深入点,可以使用vitrualJTAG这个IP核进行负复杂的验证. b8 z0 X( O1 \: K" U" o* r7 X
    一般稍复杂的项目,都有好几名工程师共同维护,顶层模块由经验丰富的工程师来设计、划分
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