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楼主: cwfang
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大家讨论一下关于ddr2的布线规则

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该用户从未签到

256#
发表于 2012-6-11 14:17 | 只看该作者
先谢谢啊!/ T$ U8 ]- Y+ N+ Z. ^) C

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257#
发表于 2012-6-14 15:12 | 只看该作者
谢谢!

该用户从未签到

258#
发表于 2012-9-8 00:46 | 只看该作者
资料收下了,非常感谢{:soso_e100:}

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259#
发表于 2012-9-10 15:24 | 只看该作者

该用户从未签到

260#
发表于 2012-9-11 12:52 | 只看该作者
alexkeli 发表于 2009-9-19 15:15
4 B8 M4 U! M4 ?! e还要讨论个啥··一般DATASHEET都有说明,自己去看。布线要求,NOTE都有!
. c1 l; B9 ?" ^- k
不管3721,先收了,3ks

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261#
发表于 2012-9-11 12:57 | 只看该作者
路过学习 赞一个0 ?% `+ t4 D+ e" Z3 J

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262#
发表于 2012-9-11 14:08 | 只看该作者
楼主是好人

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263#
发表于 2012-9-13 16:53 | 只看该作者
DDR走线并没有那么神秘,记住几点就可以了:# i. q: X8 ?4 G) ]: ^
1、长度匹配,以满足时序要求;有些情况下也不用做等长处理,软件调整一下DDR控制器的时序就可以了,我经常这样干- q" Z7 Y/ X2 W1 I( K  G% d- z
2、阻抗匹配,保证信号的完整性2 ]$ j" A0 x- o' i  ]. t  H
3、必须有完整的参考平面;我也碰到过数据线跨分割的情况,四层板,外层走线,L2为完整的GND层,L3为电源分割层,数据线有跨过电源层的分割,但不影响性能,DDR跑800M超频900M都OK
1 U# v$ N- s' {% S: T- M4、1.8v和VREF必须干净,这是基本要求了
6 w, |; P5 O. @满足以上几点,基本上就OK了

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264#
发表于 2012-9-14 17:04 | 只看该作者
收了

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265#
发表于 2012-9-17 09:15 | 只看该作者
真心给力

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266#
发表于 2012-9-17 10:11 | 只看该作者
挺好的

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267#
发表于 2012-9-17 13:50 | 只看该作者
学习中

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268#
发表于 2012-9-19 11:07 | 只看该作者
谢谢分享,学习了

该用户从未签到

269#
发表于 2012-9-20 10:28 | 只看该作者
学习学习
5 d" x* D/ |9 o2 \/ R1 z# v1 ?

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270#
发表于 2012-9-20 11:49 | 只看该作者
这个问题论坛里面已经有好多人问过了吧,可以搜一下,资料应该都有
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