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新手上路,LOGIC画了一原理图,ECO2PCB后只能在顶层布线,加过孔都加不了,ECO文件里好象只有顶层是有效层,,为什么这样??怎么解决啊??附:MODIFY_GENERAL_RULES* ROUTING! o; G: f: n. }9 W. K' [
HIERARCHY_OBJECT PCB CB
, |0 |. ] ?' @' Q) Q3 C ?LENGTH_MINIMIZATION_TYPE TOTAL
0 Q/ n# L( \6 _TRACE_SHARE ON5 n; E: `& S% @( Y
VIA_SHARE ON
* H) b! j* ^3 y7 J4 x, i( D. ]AUTO_ROUTE ON
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9 T' [" ^$ o3 yMAX_NUMBER_OF_VIAS 08 Y. q: m6 ?/ x6 u& B+ h& z
VALID_LAYER Top
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