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PCB电磁兼容检查表,还有没补充的啊

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    发表于 2019-9-23 11:38 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    x
    ( |# m( s: A# d% o: g0 w- {
    检查要素                检查结果        备注
    8 b: p0 z% ]2 q+ [; r: k- j选材与层叠设置        PCB层叠设计是否满足阻抗控制要求               
    # ~3 o, b8 m. F( h$ T$ `( G        PCB设计的材料是否满足信号速率及应用场合的要求                6 t' @" ^6 j. B! N& t3 O- X  s
            层叠是否方便生产及做到叠层结构对称                " K  D4 X% O2 A2 A- `* y7 B8 ?. r
    与电源、地平面相关事项        电源平面相对相邻地平面内缩(建议内缩20H)                3 \; G) R2 `* y0 _6 A, z2 z) V: p
            关键布线层是否与地平面相邻,优选两地平面之间                6 M0 a6 Q. g2 u+ F4 o! `
            电源、地平面分割是否合理               
    + x* v/ ~$ \" ?5 f, ^5 @& {        布线层在相邻平面层的投影在完整的同一分割平面区域内               
    & o" O% D+ X3 u- F        主电源平面做到与对应地平面相邻及间距尽量小                ) |" p- [6 ^9 R( y. \% B
            元件面的相邻平面是否为地平面               
    0 t; I, ?- R; X3 v" Q        尽量避免密集过孔、反焊盘等导致的参考平面缝隙长度过长                # O$ v$ s( i% B' T. X( v. {* ~
    电容相关检查        电流变化较大的区域放合适的电容,如电流较大的BGA下方需放电容                5 P" W' r1 X* N$ k3 t
            高速信号PCB电容的设计是否合理(可以通过PI仿真确认电容的容值、数量及位置)               
    & V$ v) N5 X% J% O, ^  z        滤波电容的电源、地做到电感最小                1 j* ~3 N( o: c8 ~0 F3 C* i( g
            在单、双面PCB中,滤波电容的走线先经滤波电容滤波,再到器件电源引脚                0 L5 |6 G- v8 g  X; G
            在单、双面PCB中,如果电源线及其回路线相距很长,可在两线间增加高频滤波电容                6 G: T: A7 O1 V% A7 w6 @1 R$ @
    布局检查        PCB整体布局参照原理功能框图,按信号流向布局                5 S/ s0 l( c5 i: p
            敏感性器件要远离PCB板边摆放               
    ; T0 s, o0 A  N4 b, b# v        电源模块、滤波器、电源防护器件靠近电源的入口放置,保证电源的输入线最短,电源的输入走线互不交叉                ( p* V1 Y. o  z; c& l* m
            接口处用信号的滤波、防护、隔离等器件靠近接口处的连接器放置,放置原则是先防护、后滤波               
    0 y/ S3 |" R# F# W        对EMI敏感器件及PLL电路需要隔离或远离辐射源放置                % Z# ?3 \) ]4 ]- a
            时钟电路拓扑可以通过仿真确认                6 g( L8 B6 T. k% V& B
            晶体、晶振、继电器、开关电源等强辐射器件或敏感器件与PCB拉手条、连接器的边缘距离足够,数字电路与模拟电路、高速电路与低速电路是否分开布局               
    # \: [: y" p& K4 D# [        多种模块电路在同一PCB上放置时,数字电路与模拟电路、高速电路与低速电路是否分开布局               
    - T% e7 y3 X# x; J        高速电路靠近相应的板边连接器放置时,做到速率高的走线尽量短,可按高、中、低速电路距板边连接器是否由近及远依次排布               
    " \& H4 c$ l: c, q        接口滤波器件(如磁珠、接口变压器、模/数、数/模等器件)的输入、输出不跨分割区               
    " f- P7 K) i( p
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     楼主| 发表于 2019-9-23 11:38 | 只看该作者
    布线检查
    走线短,间距宽,过孔少,无环路,回路面积小,无悬挂线
    - ?' Q, _+ g$ t9 p9 c8 v% }& O  }" y
    无直角,对关键信号线优先采用圆弧倒角

    & O/ M- l6 o3 q7 s5 [4 q+ H
    相邻层信号走线互相垂直或相邻层的关键信号尽量平行布线
    ) d; P$ P& ]) u
    走线线宽无跳变或设计做到尽量满足阻抗一致
    # _, a0 n$ G& L+ U; h, I" f
    电源及与对应地构成的回路面积小

    1 F; x; O* }6 U' ~( f* V3 N5 I
    共用一个电源、地过孔的引脚数目尽量少

    . {8 }  U. n+ |; F( Y
    屏蔽地线接地过孔间距与波长相关

    % Q; \# G2 D- L, Q5 [, r
    电流大于等于1A的电源所用的表贴保险丝、磁珠、电感、钽电容的焊表是否不少于两个过孔接到相应电源平面

    8 f. N; x0 L1 s; [: P8 ?
    差分信号线对是否同层、等长、并行走线,保持阻抗一致
    , f" d0 ?/ z% |/ \6 m% t+ |
    时钟等关键信号线是否布内层(优先考虑优选布线层),并加屏蔽地线或与其他布线间距满足3W原则

    2 j5 _/ G. }% G6 S
    时钟等关键信号线的过孔数目尽量少
    ) |7 U! B9 J8 e0 \2 ^9 a0 `7 G3 e/ @
    关键信号走线避免过分割区(包括过孔、焊盘导致的参考平面缝隙)

    * \+ e/ ~& M1 D( i" L( W6 O
    电源滤波器输入线下避免出现其他信号布线
    % v9 L8 X) W- {* o0 ?
    对于金属外壳接地的元件,是否在其投影区的PCB顶层上铺接地铜箔,并在相应区域开阻焊窗

    , K$ {. n7 ]2 L* J- _' f
    数、模电路之间,高、低频电路之间,高、低速电路之间布线互不交叉、跨越
    % C8 O3 }2 T9 B6 F9 z
    单、双面PCB检查项
    如没有足够的空间设计成整块铜,则需要设计成网格状

    ' O( Q6 y  n4 `8 Y" |1 H
    关键信号线是否有回流地线,且回路面积小
    ( a* v9 `3 I/ n) x) C0 z
    去耦电容、屏蔽地线是否接本器件的地电源,地之间的回路面积是否尽可能小
    $ a% ?7 K1 Z( }3 S2 E! q9 v% J
    ; L9 L6 i5 l( @; u
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