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数字通信系统中位同步信号提取的FPGA实现

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A-Lin

该用户从未签到
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1#
发表于 2019-9-2 15:15 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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数字通信系统中位同步信号提取的FPGA实现

* A+ \- u4 i9 P" q3 y1 _* U* X5 E3 s7 T( q: \4 x4 z
% z4 m: U) K' F2 I# `
同步是通信系统中非常重要的一个实际问题,是保证整个通信系统进行有序而可靠工作的技术支撑.在数字通信系统中除了载波同步外,还需要实现位同步.本文设计了一种在数字通信系统中的数字锁相法位同步提取方案,详述了位同步提取原理及其各组成功能模块的VerilogHDL语言实现,最后进行了仿真验证,将位同步提取电路集成在一片FPGA芯片上,具有体积小、功耗低、可靠性高的特点。3 L% p% y- e) c% A' d$ W1 _
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eferwu

该用户从未签到
3#
发表于 2020-5-18 14:15 | 只看该作者
感谢分享，学习学习

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@一米阳光
  • TA的每日心情
    难过
    2020-4-16 15:10

    • 签到天数: 1 天

    [LV.1]初来乍到
    4#
    发表于 2023-3-23 14:16 | 只看该作者

    5 q. c3 S- M' h/ h2 ?感谢分享，学习学习

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    瞪郜望源_21
  • TA的每日心情
    开心
    2025-7-18 15:39

    • 签到天数: 1131 天

    [LV.10]以坛为家III
    5#
    发表于 2023-3-24 11:51 | 只看该作者
    有图文字有真相，很稀饭，值得好好琢磨一下

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    prommes

    该用户从未签到
    6#
    发表于 2023-4-4 09:27 | 只看该作者
    感谢分享，学习学习

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