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楼主: ulppknot
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FPGA作为从机与STM32进行SPI协议通信---Verilog实现

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发表于 2019-8-22 15:48 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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一.SPI协议简要介绍
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9 ~; n, h2 o( ?3 l' s5 H6 TSPI,是英语Serial Peripheral InteRFace的缩写,顾名思义就是串行外围设备接口。SPI,是一种高速的,全双工,同步的通信总线,并且在芯片的管脚上只占用四根线,节约了芯片的管脚,同时为PCB的布局上节省空间,提供方便,正是出于这种简单易用的特性,现在越来越多的芯片集成了这种通信协议。% S' x* F0 I& L# z3 K
  SPI总线是Motorola公司推出的三线同步接口,同步串行3线方式进行通信:一条时钟线SCK,一条数据输入线MOSI,一条数据输出线MISO;用于 CPU与各种外围器件进行全双工、同步串行通讯。SPI主要特点有:可以同时发出和接收串行数据;可以当作主机或从机工作;提供频率可编程时钟;发送结束中断标志;写冲突保护;总线竞争保护等。
6 M6 c9 r6 S* a4 j, e" {) ~# S. k6 r; U5 \! M3 H* |
SPI总线有四种工作方式(SP0, SP1, SP2, SP3),其中使用的最为广泛的是SPI0和SPI3方式。SPI模块为了和外设进行数据交换,根据外设工作要求,其输出串行同步时钟极性和相位可以进行配置,时钟极性(CPOL)对传输协议没有重大的影响。如果CPOL=0,串行同步时钟的空闲状态为低电平;如果CPOL=1,串行同步时钟的空闲状态为高电平。时钟相位(CPHA)能够配置用于选择两种不同的传输协议之一进行数据传输。如果 CPHA=0,在串行同步时钟的第一个跳变沿(上升或下降)数据被采样;如果CPHA=1,在串行同步时钟的第二个跳变沿(上升或下降)数据被采样。5 d$ ]; e) [6 v% L- a9 Z

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3#
发表于 2019-9-21 15:48 | 只看该作者
  • TA的每日心情
    开心
    2020-9-15 15:59
  • 签到天数: 7 天

    [LV.3]偶尔看看II

    6#
    发表于 2019-10-17 19:10 | 只看该作者
    SPI总线有四种工作方式(SP0, SP1, SP2, SP3),其中使用的最为广泛的是SPI0和SPI3方式。

    该用户从未签到

    8#
    发表于 2020-6-12 00:10 | 只看该作者
    SPI总线有四种工作方式(SP0, SP1, SP2, SP3),其中使用的最为广泛的是SPI0和SPI3方式
  • TA的每日心情
    慵懒
    2020-6-24 15:17
  • 签到天数: 3 天

    [LV.2]偶尔看看I

    9#
    发表于 2020-6-14 19:49 | 只看该作者
    ????????????

    “来自电巢APP”

    该用户从未签到

    10#
    发表于 2020-6-14 19:52 | 只看该作者
    学习学习,

    “来自电巢APP”

  • TA的每日心情
    擦汗
    2022-2-25 15:37
  • 签到天数: 288 天

    [LV.8]以坛为家I

    11#
    发表于 2020-6-14 20:35 | 只看该作者
    学习学习

    “来自电巢APP”

    该用户从未签到

    12#
    发表于 2020-6-14 20:58 | 只看该作者
  • TA的每日心情
    开心
    2022-6-29 15:11
  • 签到天数: 378 天

    [LV.9]以坛为家II

    13#
    发表于 2020-6-14 22:47 | 只看该作者
  • TA的每日心情
    开心
    2021-1-29 15:36
  • 签到天数: 33 天

    [LV.5]常住居民I

    14#
    发表于 2020-6-14 23:07 | 只看该作者
    瞅瞅,有需要。

    “来自电巢APP”

    该用户从未签到

    15#
    发表于 2020-6-14 23:19 | 只看该作者
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