这个做开关电路有没有问题

hyz12888

这个做开关电路有没有问题
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hyz12888

niuth 发表于 2019-3-6 12:32
MOS管导通后，会造成栅源控制电压消失，器件自身会反复断开和导通，是这种设计思想吗？

现在SPI1_MOSI是PMOS输入有3.3V 。  我想实现NPN三极管IO口高电平导通，PMOS G极低电平导通，SPI1_MOSI拉低，现在这个电路拉不低

Frank9523

楼主的图在于虽然PMOS在NPN三极管导通情况下，G极被拉低实现了VGS<0，满足PMOS导通的条件；但一旦PMOS导通，S极会被拉到D极电位（也即拉低），此时VGS约为0，不满足PMOS导通条件，又关断了；
21#的图可实现楼主想要的功能；

hyz12888

KOGBOYQQ 发表于 2019-3-7 16:58
你的電路P4_0，LOW的時候Q3 pin2-3.3V，pin3-0V
' r6 e3 a6 i! Z; D% sP4_0 high的時候Q3 pin-3.3V, pin3-3.3V  
是嗎？

P4_0是单片机给高，NPN导通，PMOS G极变低，我想实现PMOS输入脚拉低
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renxiangbing1

我感觉有问题，
第一，应该用NMOS
第二，mos接反了，按现在的接法，信号一直都是通的，由左向右
5 Y4 a; B2 W2 m8 T

hyz12888

现在P4_0 IO口给高MMBT2222打开后，SPI1不能拉低

shineysunwxy

去掉两个管子中间的那个10K电阻就可以了

niuth

MOS管导通后，会造成栅源控制电压消失，器件自身会反复断开和导通，是这种设计思想吗？

jacky401

这种电路主要用于电源的开关，你可以先说一下你的功能需求。

fzxld1905

SPI1_MOSI应该为源端输入，off-page方向有问题。查看AO3423 Pmos的导通VGS为多少，测量一下。看这电路感觉当Q4导通后，G端电压分压了S端，确定是否能满足导通条件吧。

hyz12888

P4_0 IO口给高电平三极管导通，我想实现SPI1_MOSI 三极管导通后拉低。SPI1_MOSI 是VCC输入，

xiaojianpan

学习，学习！

千里之行

1、很明显没有用，不管输入如何变，输出都是低；
2、电路太复杂了，要考虑隔离，一个电阻，一个二极管就可以了。

th2010-gc01

% c: H3 h2 t  \" C8 k& i  V$ W
如图把G极的电阻改一下接法就没问题了！

hyz12888

th2010-gc01 发表于 2019-3-6 18:40
+ `7 l" f7 K- k- o5 n9 E如图把G极的电阻改一下接法就没问题了！

我是想实现PMOS导通后输入会拉低
% }& x# m8 Q- C0 ]  @

hyz12888

shineysunwxy 发表于 2019-3-6 10:46
去掉两个管子中间的那个10K电阻就可以了

不行
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7shmily

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