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[HyperLynx] S3C2440 用HyperLynx仿真问题求助!

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1#
发表于 2009-3-31 17:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我看他们做开发板的,数据线和地址线上都没有端接电阻做阻抗匹配!可小弟用HyperLynx做S3C2440 到 SDRAM 133M 频率的仿真时,在没加电阻的情况下,却不行啊~~~~~0 @$ {" c2 ^0 R: d; x

7 [& X* Z. W7 p6 h, G7 f
/ {8 a4 U6 a1 V. B) G; d4 J 5 ^6 A1 y$ i" C- N- ~

) A" y. O0 Q* ?' ]( G, q3 P
  X+ z* P9 }% d/ @' ?5 v6 _
' Y" ~4 g7 c0 g不知道为什么?

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发表于 2014-5-27 11:31 | 只看该作者
楼主,模型可否发一下,学习学习!649102837@qq.com

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发表于 2014-5-15 13:22 | 只看该作者
可以贴个S3C2440 IBIS模型吗
% |: H6 K2 J* f6 f) J

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2#
发表于 2009-4-1 09:38 | 只看该作者
所谓的端接匹配,可以在板子上实现,也有部分是可以on the die termination的

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3#
 楼主| 发表于 2009-4-8 08:22 | 只看该作者
呵呵,还是有点不明白。主要是看了SMDK2440的原理图地址线都加了端接电阻,而很多开发板子上都是没有的。( V: P8 W: E, z2 v# `8 y6 K7 a6 \! Z6 A

) ^$ W$ Q' k5 t$ b所以在取舍,但不知道依据是什么,也不知道是不是自己仿真的有问题?  H; p& d. R1 Z# I8 n

& H; z$ r+ \% U9 P( r' [期待有兄弟帮忙解惑一下~~~~~

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4#
发表于 2009-4-9 13:29 | 只看该作者
端接电阻的呈现形式
/ {: n" {- u6 W+ B/ V1.在PCB板级呈现,可以在板子上看到端接电阻。
  y! H0 f; g) j2.端接电阻集成在了芯片内部,板子上是看不到的。: F- e1 a% @9 t6 _) b$ z
8 z( @. E# N  V8 u, n
当然,如果板子信号质量是可以接受的那么就不用添加端接电阻

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5#
发表于 2009-4-9 14:10 | 只看该作者
端接电阻的呈现形式
) v. ^; A+ a* f0 `1.在PCB板级呈现,可以在板子上看到端接电阻。
4 V9 P) H# r9 p: V6 H2 c: i2.端接电阻集成在了芯片内部,板子上是看不到的。. M3 q4 ?2 P9 g9 Z1 Q+ Q' u" n
7 D- _4 [* A7 n/ {/ N- J
当然,如果板子信号质量是可以接受的那么就不用添加端接电阻

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6#
发表于 2009-5-30 22:47 | 只看该作者
为方便调试还是加上吧

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7#
发表于 2009-5-31 16:27 | 只看该作者
加串联端接的目的是为了消除信号的源端反射,原则是:驱动器的输出阻抗+端接电阻=线路阻抗(即PCB走线阻抗)。楼主可以看看PCB走线阻抗是否满足?

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8#
发表于 2009-5-31 19:32 | 只看该作者
请问楼主的HyperLynx软件是在那里找到的

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9#
发表于 2009-8-28 15:20 | 只看该作者
请问2楼一个问题,on the die termination是不是DDR2和DDR3才有的?普通的SDRAM没有吧

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10#
发表于 2010-3-11 15:02 | 只看该作者
楼主我用的是2410,仿真时也遇到和你一样的问题呀,一直在纠结呢

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11#
发表于 2010-4-4 16:38 | 只看该作者
学习了

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12#
发表于 2010-4-27 15:48 | 只看该作者
学习学习

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13#
发表于 2010-4-27 21:47 | 只看该作者
1. 若連源端接電阻都要省,可能途徑是再把 Microstrip 的特性阻抗再設計低一點 (30 ~ 40 Ohm),然後把Trace 再走短一點,看有沒有改善。
0 M2 R' P% ^+ h6 }1 w/ e/ u* q; {
2. SDRAM 是沒有 ODT 的。

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14#
发表于 2010-5-13 21:35 | 只看该作者
我也在做S3C2440的板子,有时间讨论一下,

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15#
发表于 2010-5-13 21:38 | 只看该作者
可以加我,QQ:195517713
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