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楼主: alooha
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高速数字电路中的终端匹配技术!

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46#
发表于 2010-9-8 15:19 | 只看该作者
图片上的计算公式看不到,楼主可以提供么?

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47#
发表于 2011-1-27 14:32 | 只看该作者
努力学习模电

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48#
发表于 2011-2-18 20:19 | 只看该作者
讲得很好,收藏了

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49#
发表于 2011-2-19 19:01 | 只看该作者
谢谢分享!!

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50#
发表于 2011-2-28 19:23 | 只看该作者
多谢分享,有用!

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51#
发表于 2011-3-10 16:45 | 只看该作者
难懂呀

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52#
发表于 2011-3-10 22:15 | 只看该作者
这个好像有一个专门的文章介绍匹配的,大家也可以上网找找,我不记得在哪里有了

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53#
发表于 2011-5-6 19:13 | 只看该作者
很好的帖子,学习了!

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54#
发表于 2011-5-24 18:24 | 只看该作者
学习了

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55#
发表于 2011-5-29 17:47 | 只看该作者
讲的非常易懂透彻,好东西!
3 W: a' ^  p% p' w, f2 B# {; q, S% I. ~1 D- d* u& L3 H0 \

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56#
发表于 2011-6-9 19:59 | 只看该作者
《而在接收端,由于传输线阻抗和接收器阻抗的不匹配,通常情况下接收器的输出阻抗更高,这会导致大约同样幅度值信号的反射,这称之为附加的信号波形。》这是串行终端匹配技术提到的?这个有点理解不了,哪位高手给解释下
- s; D: A7 s9 y6 e1 l6 c* y1 v) b

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57#
发表于 2011-6-14 21:04 | 只看该作者
不知道多负载的情况下,一般怎样端接,如菊花链、星型的。

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58#
发表于 2011-6-23 16:36 | 只看该作者
CaesarWong 发表于 2011-6-14 21:04 " w+ i4 l1 \) h# S
不知道多负载的情况下,一般怎样端接,如菊花链、星型的。

* A# X3 r3 e- ]' N同问!
& a, y4 t0 C7 X6 K
, E9 W5 z; v* h% g如果为了信号完整性(比如为了信号不反射)而在终端加匹配电阻一般是50欧到地,但是我看到某芯片如下的FAQ,怎么理解?0 {4 U3 Q2 F7 c/ N0 c# W
Q: To avoidreflections, how do I have to terminate the LVTTL and LVPECL signals?' J- ?* C# ?3 U- w' H
1 K. [0 Y2 u7 g: ~% x4 E
A:  LVPECL: via 50 Ohm to VECL = 1.25V, LVTTL: 51 k against GND

+ O4 a/ {; x- K; |. V

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59#
发表于 2011-7-7 08:50 | 只看该作者
描述得不错。
  • TA的每日心情
    开心
    2022-6-15 15:43
  • 签到天数: 3 天

    [LV.2]偶尔看看I

    60#
    发表于 2011-7-20 12:11 | 只看该作者
    回复 alooha 的帖子5 J$ w) _# u) J+ I

    * F! y$ H+ e- q1 i/ h" [6 K很好的资料!多谢分享!
    . f# ]: e" t" K2 D0 Q/ V5 F
    [url=https://www.eda365.com/thread-19-1-1.html][/url]0 G, R2 q( i: R* ^2 T. f  G
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