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关于等长线的问题

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1#
发表于 2009-3-9 14:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
我的板子有64根数据线% X8 B/ f9 O  Y" R5 H4 l
在top层不能完全布通 需要把其中一部分布到内层4 F: w3 G6 u  S
这样走内层的线每根至少要两个过孔
/ f! x; X- {$ ]! u- A% V% k请问这样布等长线的话过孔的长度可以忽略不计吗! P% J& i& K0 L* }
而且内层的信号速度和top层的信号速度不一样4 x# h3 c/ N% g/ ?$ |# C- c
那么改如何做到数据线等长呢
& ^" u8 `: t9 ?+ s! R8 `9 K  D) V, `2 W& k; b
请各位帮个忙指导一下
" \& ^# e$ N: D6 s谢谢了

该用户从未签到

2#
发表于 2009-3-9 15:10 | 只看该作者
而且内层的信号速度和top层的信号速度不一样
' W. s$ X& h& b: q那么改如何做到数据线等长呢# n4 k& C8 Q7 a0 B' z9 L5 x" q# \
————————————————————————0 b  ~, j% B) h! ~
这点我也想知道。& y0 [: Z7 B6 I& O- h
% X/ h# j6 C* \( r+ {
另外,100Mhz的SDRAM的布线要求应该不是太苛刻吧,只要使SDRAM尽量靠近CPU,时钟线尽量短,布线随便布就可以。跑起来就没问题。(SDRAM是100MHz的情况。)' K# u' M# ~9 h0 y
过孔应该可以不可虑。但是如果考虑的话,应该如何计算?
5 `! w- W5 V" n5 v1 Y同问。

该用户从未签到

3#
 楼主| 发表于 2009-3-9 17:20 | 只看该作者
高手来指导下呀

该用户从未签到

4#
发表于 2009-4-12 09:07 | 只看该作者
过孔对上升时间的影响,差不多也就十几二十皮秒,对于这个速度的可以不考虑了。对阻抗倒是影响大些

该用户从未签到

5#
发表于 2009-4-15 17:42 | 只看该作者
???????

该用户从未签到

6#
发表于 2009-4-26 01:14 | 只看该作者
一般情况下,一个过孔等于2~3MM的长度。SDRAM,DDRI,LAYOUT时可以不考虑。1 c/ I4 h+ e0 m. G+ r
但DDRII,DDRIII需要考虑。
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