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PADS转过来的ALLEGRO怎么生成位号

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1#
发表于 2018-3-22 16:28 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 xierjlove77 于 2018-3-22 16:29 编辑
9 t3 c+ x/ S7 }0 Z4 b$ M6 }5 X  {6 [0 s
如题,从pads转过来的allegro,只有线路,铜皮等,怎么生成位号呢?有没有什么办法呢?急急0 ]" H5 s/ {8 R

APR4@LG4H6186GO4LAWX)G4.png (87.11 KB, 下载次数: 12)

APR4@LG4H6186GO4LAWX)G4.png

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发表于 2018-3-23 15:13 | 只看该作者
主要是路径的问题,把所有的东西放在同一个路径下,然后在ALLEGRO里面指向该路径,位号就不会丢失

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3#
 楼主| 发表于 2018-3-22 18:54 | 只看该作者
yangjinxing521 发表于 2018-3-22 17:15
( J) u3 {4 M/ L: A重导网表。。。。
2 z) h" X0 ^5 i2 a7 L7 r' A
重蹈网表,后面的器件要一个一个替换吗?
: b6 o' V) |+ g

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4#
发表于 2018-3-22 19:56 | 只看该作者
本帖最后由 這侽孓譙悴丶 于 2018-3-22 20:00 编辑 , J! m, D1 g- G  J# G; E

; u/ w5 g: H* X- G0 C! j( n处理下封装:焊盘名称,阻焊和钢网,封装各层refdes文字添加。如果有skill工具就可以批量处理,十几秒就整个库都搞定了,如果没有就得一个一个手动去搞了!封装处理好之后就将库更新到PCB上去就OK了,如果担心转过去的网络掉了或有些器件丢了最好更新下网表,一般如果器件的位号和网络命名中都没有allegro中认为是非法字符的,导过去器件和网络是不会丢失。如果有那就会丢失,比如,有个器件的位号为C*1,其中的*这个字符就是非法字符,那么转过去C*1这个器件连同它pin脚上的网络就会丢失;至于如果是Power Logic的网表可以使用skill转换为allegro第三方网表直接调入allegro里面。

点评

已经整理好库了,要怎么搞呢?谢谢!  详情 回复 发表于 2018-3-22 20:13

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5#
 楼主| 发表于 2018-3-22 20:13 | 只看该作者
這侽孓譙悴丶 发表于 2018-3-22 19:56  {' b* l, `. V, s/ {
处理下封装:焊盘名称,阻焊和钢网,封装各层refdes文字添加。如果有skill工具就可以批量处理,十几秒就整 ...
) E6 V' {4 A" K
已经整理好库了,要怎么搞呢?谢谢!! E/ v; A1 k  J9 U

点评

不是说的很清楚了么,不懂就加过了!  详情 回复 发表于 2018-3-22 20:31

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6#
发表于 2018-3-22 20:31 | 只看该作者
xierjlove77 发表于 2018-3-22 20:13' m: h8 M6 @2 @$ U1 a" [& n2 r
已经整理好库了,要怎么搞呢?谢谢!

* P# q* B  n+ Z9 b5 E% z6 b& |3 l) Z不是说的很清楚了么,不懂就加过了!
1 o, u# Z( t4 n5 X5 M) X

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8#
发表于 2018-3-23 11:14 | 只看该作者
最好是重新导网表,这样会安全很多

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11#
发表于 2018-3-31 14:46 | 只看该作者
厉害了。学习到了
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