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2017年12月29日QA检查报告节选

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发表于 2017-12-30 08:53 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
1.电源太细; y8 Q/ x$ Z9 f. R* J* E: B
- M9 N' `, Q6 l
[url=https://www.eda365.com/thread-160823-1-1.html][/url]
/ \; C, m. x# f4 e) v$ G4 R! |

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发表于 2018-1-2 20:11 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53" i* r& G# q5 w) l% s# U
4.多个千兆网口线建议有参考面
7 F& J! K5 O, M  n1 e  ^2 @+ t! n
为啥有参考面,以哪个地作为参考面?机壳地?打静电时有没有影响,有什么理论依据,我设计的一块也是多个千兆网口,一开始是机壳地做参考,最后还是没做参考,EMC测试没问题。  _( v/ C5 C9 D4 }5 T

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发表于 2018-1-2 09:29 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53: {+ ?; e6 y) Q: x3 s
4.多个千兆网口线建议有参考面
6 C+ j" N6 T+ b$ l) `
请教一下,这个参考面是需要用外壳地来做吗?
  f: `# j5 ]; C' }* k# M9 ]

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发表于 2018-1-2 13:30 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53
" }' F0 q4 K. V5 ^7 s; V" n4.多个千兆网口线建议有参考面
' j; f7 v; B7 b! Y5 o  w
建议用中心抽头上的地,不能用机壳地!( e2 T  u8 X' ~! k

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2#
 楼主| 发表于 2017-12-30 08:53 | 只看该作者
2.电感加强# L; n" h3 I4 Q# j: n
# K" E, A) K- d

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3#
 楼主| 发表于 2017-12-30 08:53 | 只看该作者
3.电阻两端需等长4 f1 ]) M. M, l- i6 b6 u

5 j1 L! G6 z3 H; i+ v

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4#
 楼主| 发表于 2017-12-30 08:53 | 只看该作者
4.多个千兆网口线建议有参考面& b- r$ R) ], `4 P5 O
8 x# T3 e. {' \# ]6 C/ I

点评

为啥有参考面,以哪个地作为参考面?机壳地?打静电时有没有影响,有什么理论依据,我设计的一块也是多个千兆网口,一开始是机壳地做参考,最后还是没做参考,EMC测试没问题。  详情 回复 发表于 2018-1-2 20:11
建议用中心抽头上的地,不能用机壳地!  详情 回复 发表于 2018-1-2 13:30
请教一下,这个参考面是需要用外壳地来做吗?  详情 回复 发表于 2018-1-2 09:29

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5#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
5.USB参考平面要完整
5 ^; O( ?3 s+ t6 K0 r2 |- p
9 k, i! x$ c; x- K' |" U) a" ?

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6#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
6.电源有瓶颈
& h# f) ?7 r8 v& X / G+ ]  P5 ?0 n4 f" X4 R. H, U

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7#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
7.有部分模拟线没加粗
& w7 u, u* F; H( v: h
1 {+ b  S1 o0 M* ]

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8#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
8.电源加粗
+ h; o" m4 O: W- Z " H' }" d# b; O) i* `4 d; ~

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9#
 楼主| 发表于 2017-12-30 08:54 | 只看该作者
9.CAN走差分. _9 i& m9 j! e. B8 y

% r7 N7 T. Q: R. c' ?5 T

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10#
 楼主| 发表于 2017-12-30 08:55 | 只看该作者
10.电源输入在电容前打VIA,输出电源加粗.
: |, E# l+ d% ^/ C/ M( Z0 O , s- N$ C3 [* t  v" v
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